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參數(shù)資料
| 型號： | MC145572 |
| 廠商： | Motorola, Inc. |
| 英文描述： | ISDN U-Interface Transceiver(ISDN U接口收發(fā)器) |
| 中文描述： | 綜合業(yè)務數(shù)字網(wǎng)U型接口收發(fā)器（綜合業(yè)務數(shù)字網(wǎng)ü接口收發(fā)器） |
| 文件頁數(shù)： | 49/264頁 |
| 文件大?。?/td> | 2832K |
| 代理商： | MC145572 |
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MC145572
4–13
MOTOROLA
This register contains the reserved M5 and M6 bits that are sent by the Superframe Framer. The bits
written to the register are sent out on the next transmit superframe boundary, if Superframe Update
Disable (NR2(b1)) is set to 0. All bits are set to 1s following a Hardware Reset (RESET) or Software
Reset (NR0(b3)). See BR9(b1) for details concerning use of the far–end block error
(febe)
Input,
b4. Bits b7, b6, and b5 are double buffered. When BR10(b0) = 1, this register is replaced by Register
OR2.
CAUTION
Reserved bits b0, b1, b2, and b3 should be set to 0 at all times to maintain future com-
patibility.
b7
b6
b5
b4
b3
b2
b1
b0
BR2
M50
M60
M51
febe
Input
Reserved
Reserved
Reserved
Reserved
rw
ANSI T1.601–1992 presently reserves bits M50, M60, and M51. Therefore, these bits should be set to 1s for ISDN
applications.
febe
Input
The value in this bit is enabled to be transmitted as
febe
when BR9(b1) is set to 1.
This register contains the ANSI T1.601–1992 reserved M5 and M6 bits that are received by the
Superframe Deframer, occurring in basic frames 1 and 2 of the superframe, and four other Superframe
Deframer status bits. The M5 and M6 values in the register are valid when the Superframe Sync
bit, NR1(b1), is 1. M50, M51, and M60 are updated, based on the mode set in Register BR9(b3:b2).
Bits b7, b6, and b5 are double buffered. They can be read at any time during the superframe prior
to the next update. It is recommended that this register be read as soon as possible after an M5/M6
channel interrupt. Refer to the description of BR9(b3:b2) for details concerning the operation of these
three bits. When BR10(b0) = 1, this register is replaced by Register OR3.
b7
b6
b5
b4
b3
b2
b1
b0
BR3
M50
M60
M51
Received
febe
Computed
febe
Verified
act
Verified
dea
Super-
frame
Detect
ro/wo
ro/wo
ro/wo
ro
ro
ro
ro
ro
Received
febe
This is the state of the received
febe
bit in the last complete received superframe. It is updated at
the end of each received superframe when Superframe Sync (NR1(b1)) and Linkup (NR1(b3)) are
both 1s.
Computed
nebe
This is the state of the cyclic redundancy check
(crc)
check from the last complete received super-
frame. It is updated at the end of each received superframe. This bit is 0 when a
crc
error is detected.
Also, when either Superframe Sync (NR1(b1)) or Linkup (NR1(b3)) is 0, this computed near–end block
error
(nebe)
bit is forced to 0.
Verified
act
This is the dual–consecutively checked setting of the
act
bit in the received superframe. Dual–con-
secutive checking requires that the received bit be in the same state for two consecutive superframes.
Whenever the U–interface transceiver detects a transition from 0 to 1 on Superframe Sync, NR1(b1),
Verified
act
is set to 0. It remains in its current state until both Superframe Sync (NR1(b1)) and Linkup
(NR1(b3)) are 1s. Then, if the received
act
bit is 1 for two consecutive superframes, Verified
act
becomes a 1. After Verified
act
becomes a 1, it changes to 0 if the received
act
bit is received as
相關PDF資料 |
PDF描述 |
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相關代理商/技術參數(shù) |
參數(shù)描述 |
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| MC145572APB | 功能描述:IC ISDN INTERFACE TXCVER 44-LQFP RoHS:否 類別:集成電路 (IC) >> 接口 - 驅動器，接收器，收發(fā)器 系列:- 標準包裝:1,000 系列:- 類型:收發(fā)器 驅動器/接收器數(shù):2/2 規(guī)程:RS232 電源電壓:3 V ~ 5.5 V 安裝類型:表面貼裝 封裝/外殼:16-SOIC（0.295"，7.50mm 寬） 供應商設備封裝:16-SOIC 包裝:帶卷 (TR) |
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