參數(shù)資料
型號(hào)： M7A3PE600-FFGG484I
元件分類： FPGA
英文描述： FPGA, 600000 GATES, PBGA484
封裝： 1 MM PITCH, GREEN, FBGA-484
文件頁數(shù)： 93/168頁
文件大?。?/td> 1335K
代理商： M7A3PE600-FFGG484I
ProASIC3E Flash Family FPGAs
2- 18
Advanced v0.5
CCC Electrical Specifications
Timing Characteristics
Table 2-4 ProASIC3E CCC/PLL Specification
Parameter
Min.
Typ.
Max.
Unit
Clock Conditioning Circuitry Input Frequency fIN_CCC
1.5
350
MHz
Clock Conditioning Circuitry Output Frequency fOUT_CCC
0.75
350
MHz
Delay Increments in Programmable Delay Blocks1, 2
200
ps
Number of Programmable Values in Each Programmable Delay Block
32
Input Period Jitter
1.5
ns
CCC Output Peak-to-Peak Period Jitter FCCC_OUT
Max Peak-to-Peak Period Jitter
1 Global
Network
Used
3 Global
Networks
Used
0.75 MHz to 24 MHz
0.50
0.70
%
24 MHz to 100 MHz
1.00
1.20
%
100 MHz to 250 MHz
1.75
2.00
%
250 MHz to 350 MHz
2.50
5.60
%
Acquisition Time
150
s
Output Duty Cycle
48.5
51.5
%
Delay Range in Block: Programmable Delay 1 1, 2
0.6
5.56
ns
Delay Range in Block: Programmable Delay 2 1, 2
0.025
5.56
ns
Delay Range in Block: Fixed Delay 1, 2
2.2
ns
Notes:
1. This delay is a function of voltage and temperature. See Table 3-6 on page 3-4 for deratings.
2. TJ = 25°C, VCC = 1.5 V
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PDF描述
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