參數(shù)資料
型號： IDT88K8483BRI
廠商： IDT, Integrated Device Technology Inc
文件頁數(shù)： 8/162頁
文件大小： 0K
描述： IC SPI-4 EXCHANGE 3PORT 672-BGA
標準包裝： 24
系列： *
其它名稱： 88K8483BRI
105 of 162
October 20, 2006
IDT IDT88K8483
SPI-4 Registers
SPI-4 Ingress LP to LID Mapping Table
SPI-4 Ingress Calendar 0 Table
SPI-4 Ingress Calendar 1 Table
Field
Read /
Write
Bits
Length Reset
State
Description
N
R/W
0:0 - 0:5
6
0
LID number.This field maps the LP to the LID in the PFP and can take any 1 of 64
possible LID values. The LP number is the register offset. Refer to Figure 3 and Fig-
ure 4 for LID information.
P
R/W
0:6
1
0
Selects module A or module B ingress, valid for main.
0:Module A.
1:Module B.
Reserved
R
0: 7
1
0
Reserved bit.
ENABLE
R/W
1:0
1
0
Enables or disables this LP connection to the LID.
0:Disable.
1:Enable.
Table 54 SPI-4 Ingress LP to LID Mapping Table (Block Base=0x0000, Register Offset=0x00-0xff)
Field
Read /
Write
Bits
Length Reset
State
Description
LP
R/W
0:7
8
0xFF
The LP value programmed schedules a status channel update according to the
calendar sequence.
Note: (1)There are 128 table entries for SPI-4 main interface and 64 table entries for SPI-4 tributary interface.
(2)The IDT88K8483 and the attached device must have identical calendars for ingress and the attached egress device.
Table 55 SPI-4 Ingress Calendar 0 Table (Block Base=0x0100, Register Offset=0x00-0x3f/0x7f)
Field
Read /
Write
Bits
Length Reset
State
Description
LP
R/W
0:7
8
0xFF
The LP value programmed schedules a status channel update according to the
calendar sequence.
Note: (1)There are 128 table entries for SPI-4 main interface and 64 table entries for SPI-4 tributary interface.
(2)The IDT88K8483 and the attached device must have identical calendars for ingress and the attached egress device.
Table 56 Ingress Calendar 1 Table (Block Base=0x0200, Register Offset=0x00-0x3f/0x7f)
相關PDF資料
PDF描述
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參數(shù)描述
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IDT88P8344 制造商:IDT 制造商全稱:Integrated Device Technology 功能描述:SPI EXCHANGE 4 x SPI-3 TO SPI-4 Issue 1.0
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