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參數(shù)資料
| 型號： | DS33ZH11+ |
| 廠商： | Maxim Integrated Products |
| 文件頁數(shù)： | 49/172頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MAPPER ETHERNET 100CSBGA |
| 產(chǎn)品培訓(xùn)模塊： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 標(biāo)準(zhǔn)包裝： | 7 |
| 應(yīng)用： | 數(shù)據(jù)傳輸 |
| 接口： | 串行 |
| 電源電壓： | 1.8V，2.5V，3.3V |
| 封裝/外殼： | 100-LFBGA，CSPBGA |
| 供應(yīng)商設(shè)備封裝： | 100-CSBGA（10x10） |
| 包裝： | 托盤 |
| 安裝類型： | 表面貼裝 |
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DS33Z11 Ethernet Mapper
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10 FUNCTIONAL TIMING
10.1 Functional Serial I/O Timing
The Serial Interface provides flexible timing to interconnect with a wide variety of serial interfaces. TDEN is an
input signal that can be used to enable or block the TSER data. The “shaded bits” are not clocked by the
DS33Z11. The TDEN must occur one bit before the effected bit in the TSER stream. Note that polarity of the
TDEN is selectable through LI.TSLCR. In the figure below, TDEN is active low , allowing the bits to clock and
inactive high, causing the next data bit not be clocked. TCLK can be gapped as shown in the following figure.
Similarly, the receiver function is governed by RCLKI, RDEN and RSER. RSER data will not be provided to the
receiver for the bits blocked when RDEN is inactive. The RDEN polarity can be programmed by LI.RSLCR. The
RDEN signal must be coincident with the RSER bit that needs to be blocked.
Figure 10-1 TX Serial Interface Functional Timing
TCLK
gapped
TSER
TCLKI
TDEN
TSER
TCLK Gapped
TSER
Figure 10-2 RX Serial Interface Functional Timing
TSER
RCLKI
RDEN
RSER
RCLK Gapped
RSER
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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| DS33ZH11+ | 功能描述:網(wǎng)絡(luò)控制器與處理器 IC 10/100 ENETXPORT HMODE MAP IND RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
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