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參數(shù)資料
| 型號： | DS33ZH11+ |
| 廠商： | Maxim Integrated Products |
| 文件頁數(shù)： | 21/172頁 |
| 文件大小： | 0K |
| 描述： | IC MAPPER ETHERNET 100CSBGA |
| 產(chǎn)品培訓(xùn)模塊： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 標準包裝： | 7 |
| 應(yīng)用： | 數(shù)據(jù)傳輸 |
| 接口： | 串行 |
| 電源電壓： | 1.8V，2.5V，3.3V |
| 封裝/外殼： | 100-LFBGA，CSPBGA |
| 供應(yīng)商設(shè)備封裝： | 100-CSBGA（10x10） |
| 包裝： | 托盤 |
| 安裝類型： | 表面貼裝 |
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DS33Z11 Ethernet Mapper
117 of 172
Register Name:
SU.MACAWH
Register Description:
MAC Address Write High
Register Address:
14Bh
Bit #
7
6
5
4
3
2
1
0
Name
MACAW
15
MACAW
14
MACAW
13
MACAW1
2
MACAW1
1
MACAW1
0
MACAW9
MACAW8
0
Bits 0 – 7: MAC Write Address (MACAW8-15) High byte of the MAC address. Used only for write operations.
Register Name:
SU.MACRWC
Register Description:
MAC Read Write Command Status
Register Address:
14Ch
Bit #
7
6
5
4
3
2
1
0
Name
-
MCRW
MCS
Default
0
Bit 1: MAC Command RW (MCRW) If this bit is written to 1, a read is performed from the MAC. If this bit is
written to 0, a write operation is performed. Address information for write operations must be located in
SU.MACAWH and SU.MACAWL. Address information for read operations must be located in SU.MACRADH and
SU.MACRADL. The user must also write a 1 to the MCS bit, and the DS33Z11 will clear MCS when the operation
is complete.
Bit 0: MAC Command Status (MCS) Setting MCS in conjunction with MCRW will initiate a read or write to the
MAC registers. Upon completion of the read or write this bit is cleared. Once a read or write command has been
initiated the host must poll this bit to see when the operation is complete.
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參數(shù)描述 |
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