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參數(shù)資料
| 型號： | DS33ZH11+ |
| 廠商： | Maxim Integrated Products |
| 文件頁數(shù)： | 37/172頁 |
| 文件大小： | 0K |
| 描述： | IC MAPPER ETHERNET 100CSBGA |
| 產(chǎn)品培訓模塊： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 標準包裝： | 7 |
| 應用： | 數(shù)據(jù)傳輸 |
| 接口： | 串行 |
| 電源電壓： | 1.8V，2.5V，3.3V |
| 封裝/外殼： | 100-LFBGA，CSPBGA |
| 供應商設備封裝： | 100-CSBGA（10x10） |
| 包裝： | 托盤 |
| 安裝類型： | 表面貼裝 |
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DS33Z11 Ethernet Mapper
131 of 172
Register Name:
SU.MACFCR
Register Description:
MAC Flow Control Register
Register Address:
001Ch (indirect)
001Ch:
Bit #
31
30
29
28
27
26
25
24
Name
PT15
PT14
PT13
PT12
PT11
PT10
PT09
PT08
Default
0
001Dh:
Bit #
23
22
21
20
19
18
17
16
Name
PT07
PT06
PT05
PT04
PT03
PT02
PT01
PT00
Default
0
1
0
1
0
001Eh:
Bit #
15
14
13
12
11
10
09
08
Name
Reserved
Default
0
001Fh:
Bit #
07
06
05
04
03
02
01
00
Name
Reserved
Reserve
d
Reserved
FCE
FCB
Default
0
1
0
Bits 16 - 31: Pause Time (PT[00:15]) These bits are used for the Pause Time Field in transmitted Pause
Frames. This value is the number of time slots the remote node should wait prior to transmission.
Bit 1: Flow Control Enable (FCE) When set to 1, the MAC automatically detects pause frames and will disable
the transmitter for the requested pause time.
Bit 0: Flow Control Busy (FCB) The host can set this bit to 1 in order to initiate transmission of a pause frame.
During transmission of a pause frame, this bit remains set. The DS33Z11 will clear this bit when transmission of
the pause frame has been completed. The user should read this bit and ensure that this bit is equal to zero prior
to initiating a pause frame.
相關(guān)PDF資料 |
PDF描述 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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| DS33ZH11+ | 功能描述:網(wǎng)絡控制器與處理器 IC 10/100 ENETXPORT HMODE MAP IND RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
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