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參數(shù)資料
| 型號： | UPD70F3214HY |
| 廠商： | NEC Corp. |
| 英文描述： | 32-Bit Single-Chip Microcontrollers |
| 中文描述： | 32位單芯片微控制器 |
| 文件頁數(shù)： | 303/861頁 |
| 文件大?。?/td> | 3910K |
| 代理商： | UPD70F3214HY |
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CHAPTER 8 16-BIT TIMER/EVENT COUNTER 0
User’s Manual U16890EJ1V0UD
303
(3) 16-bit timer output control register 0n (TOC0n)
The TOC0n register controls the operation of the 16-bit timer/event counter 0n output controller by setting or
resetting the timer output F/F, enabling or disabling inverse output, enabling or disabling the timer of 16-bit
timer/event counter 0n, enabling or disabling the one-shot pulse output operation, and selecting an output
trigger for a one-shot pulse by software (16-bit timer/event counters 02 and 03 do not have a one-shot pulse
output function).
The TOC0n register can be read or written in 8-bit or 1-bit units.
After reset, TOC0n is cleared to 00H.
(1/2)
0
One-shot pulse output
OSPT0m
Note 1
0
1
Output trigger for one-shot pulse by software
TOC0n
(n = 0 to 3
m = 0, 1)
OSPT0m
Note 1
OSPE0m
Note 1
TOC0n4
LVS0n
LVR0n
TOC0n1
TOE0n
Successive pulse output
One-shot pulse output
Note 2
OSPE0m
Note 1
0
1
Control of one-shot pulse output operation
Inversion operation disabled
Inversion operation enabled
TOC0n4
0
1
Control of timer output F/F upon match of CR0n1 register and TM0n register
After reset: 00H R/W Address: TOC00 FFFFF609H, TOC01 FFFFF619H,
TOC02 FFFFF629H, TOC03 FFFFF639H
7
<6>
<5>
4
<3>
<2>
1
<0>
Notes 1.
16-bit timer/event counters 02 and 03 do not provide a one-shot pulse output function. Be sure
to clear the OSPE02, OSPE03, OSPT02, and OSPT03 bits to 0. 16-bit timer/event counters 00
and 01 are the alternate-function pins of the timer I/O pins, so only a software trigger is valid for
one-shot pulse output. Clear the TMC00.TMC001 and TMC01.TMC011 bits to 0.
2.
The one-shot pulse output operates normally only in the free-running timer mode. In the mode
in which clear & start occurs on match between the TM0m register and the CR0m0 register,
one-shot pulse output is not performed because no overflow occurs.
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