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參數(shù)資料
| 型號： | SYM53C1010-33 |
| 廠商： | LSI Corporation |
| 英文描述： | PCI to Dual Channel Ultra3 SCSI Multifunction Controller(PCI與雙通道Ultra3 SCSI連接的多功能控制器) |
| 中文描述： | PCI到雙通道個Ultra3 SCSI多功能控制器（與雙通道的PCI個Ultra3 SCSI連接的多功能控制器） |
| 文件頁數(shù)： | 163/384頁 |
| 文件大小： | 3924K |
| 代理商： | SYM53C1010-33 |
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SCSI Registers
4-41
interrupts). The DIP bit in the
Interrupt Status Zero (ISTAT0)
register is
also cleared. It is possible to mask DMA interrupt conditions individually
through the
DMA Interrupt Enable (DIEN)
register.
When performing consecutive 8-bit reads of the
DMA Status (DSTAT)
,
SCSI Interrupt Status Zero (SIST0)
and
SCSI Interrupt Status One
(SIST1)
registers (in any order), insert a delay equivalent to 12 CLK
periods between the reads to ensure that the interrupts clear properly.
See
Chapter 2, “Functional Description”
for more information on
interrupts.
DFE
DMA FIFO Empty
This status bit is set when the DMA FIFO is empty. It is
possible to use it to determine if any data resides in the
FIFO when an error occurs and an interrupt is generated.
This bit is a pure status bit and does not cause an
interrupt.
7
MDPE
Master Data Parity Error
This bit is set when the SYM53C1010 SCSI function,
acting as a PCI master, detects a data parity error, or,
acting as a target device, signals a parity error during a
data phase. This bit is completely disabled by the Master
Parity Error Enable bit (bit 3 of
Chip Test Four (CTEST4)
).
6
BF
Bus Fault
This bit is set when a PCI bus fault condition is detected.
A PCI bus fault can only occur when the SYM53C1010
SCSI function is bus master, and is defined as a cycle
that ends with a Bad Address or Target Abort Condition.
5
ABRT
Aborted
This bit is set when an abort condition occurs. An abort
condition occurs when a software abort command is
issued by setting bit 7 of the
Interrupt Status Zero
(ISTAT0)
register.
4
SSI
Single Step Interrupt
If the Single-Step Mode bit in the
DMA Control (DCNTL)
register is set, this bit is set and an interrupt generated
after successful execution of each SCRIPTS instruction.
3
SIR
SCRIPTS Interrupt Instruction Received
This status bit is set whenever an interrupt instruction is
evaluated as true.
2
相關PDF資料 |
PDF描述 |
|---|---|
| SYM53C1010R | PCI-Dual Channel Ultra160 SCSI Controller(PCI-雙通道Ultra160 SCSI控制器) |
| SYM53C1010 | PCI-Single Channel Ultra160 SCSI Controller(PCI-單通道Ultra160 SCSI控制器) |
| SYM53C120 | SCSI Bus Expander(SCSI總線擴展器) |
| SYM53C140 | Ultra2 SCSI Bus Expander(Ultra2 SCSI總線擴展器) |
| SYM53C141 | SCSI Bus Expander(SCSI總線擴展器) |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| SYM53C141 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Interface IC |
| SYM53C400A | 制造商:SYMBIOS 功能描述: |
| SYM53C770 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:SCSI Bus Interface/Controller |
| SYM53C876E(PBGA) | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:SCSI Bus Interface/Controller |
| SYM53C876E(PQFP) | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:SCSI Bus Interface/Controller |
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