參數(shù)資料
型號(hào)： M32196F8UFP
元件分類： 微控制器/微處理器
英文描述： 32-BIT, FLASH, 160 MHz, RISC MICROCONTROLLER, PQFP144
封裝： 20 X 20 MM, 0.50 MM PITCH, PLASTIC, LQFP-144
文件頁數(shù)： 248/1044頁
文件大?。?/td> 5857K
代理商： M32196F8UFP
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DMAC
9
9-27
32192/32195/32196 Group Hardware Manual
Rev.1.10 REJ09B0123-0110 Apr.06.07
9.2 DMAC Related Registers
[DMnCNT0 Register]
(1) MDSELn (DMAn Transfer Mode Select) bit (Bit 0)
When performing DMA transfer in single transfer mode, this bit selects normal mode or ring buffer mode.
Setting this bit to "0" selects normal mode and setting it to "1" selects ring buffer mode.
The number of transfers in the ring buffer mode is selected with register DMnCNT2.
(2) TREQFn (DMAn Transfer Request Flag) bit (Bit 1)
This flag indicates if there are DMA transfer requests for each channel. This bit is set to "1," when DMA
transfer requests are occurred in spite of TENLn bit setting value and then after completing transmission, it
is cleared to "0."
And when write "0" to this bit, it clear DMA transfer requests occurred. When write "1," it keeps value which
before writing.
If a new DMA transfer request occurs on a channel for which the DMA transfer request flag has already
been set to "1," the next DMA transfer request is not accepted until the transfer being performed on that
channel is completed.
(3) REQSLn (DMAn Transfer Request Source Select) bits (Bits 2, 3)
These bits select the cause or source of DMA transfer request on each DMA channel.
(4) TENLn (DMAn Transfer Enable) bit (Bit 4)
When setting this bit to "1" (enable transfer), DMA transfer is enable and when all transmissions are com-
pleted (underflow of transfer count register), it is cleared to "0." And when DMA transfer request is already
occurred and set to transfer enable, DMA transfer starts immediately so that make sure not to do that.
When setting this bit to "0" (disable transfer), DMA transfer is disable. However, if a transfer request has
already been accepted, transfers on that channel are not disabled until after the requested transfer is com-
pleted.
(5) TSZSLn (DMAn Transfer Size Select) bit (Bit 5)
This bit selects the number of bits to be transferred in one DMA transfer operation (the unit of one transfer).
The unit of one transfer is 16 bits when TSZSL = "0" or 8 bits when TSZSL = "1."
(6) SADSLn (DMAn Source Address Direction Select) bit (Bit 6)
This bit selects the direction in which the source address changes. This mode can be selected from two
choices: Address fixed or Address incremental.
(7) DADSLn (DMAn Destination Address Direction Select) bit (Bit 7)
This bit selects the direction in which the destination address changes. This mode can be selected from two
choices: Address fixed or Address incremental.
Extended DMA transfer
request source selected
DMAn transfer
request source
S
DMAn
Figure 9.2.1 Block Diagram of Extended DMAn Transfer Request Source Selection
相關(guān)PDF資料
PDF描述
M32192F8TFP 32-BIT, FLASH, 160 MHz, RISC MICROCONTROLLER, PQFP144
M32192F8UWG 32-BIT, FLASH, 160 MHz, RISC MICROCONTROLLER, PBGA224
M32192F8VFP 32-BIT, FLASH, 128 MHz, RISC MICROCONTROLLER, PQFP144
M32192F8VFP 32-BIT, FLASH, 128 MHz, RISC MICROCONTROLLER, PQFP144
M33230GS-20 32-BIT, 20 MHz, MICROPROCESSOR, CPGA179
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
M321-SERIES 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Peripheral IC
M-322 功能描述:單板計(jì)算機(jī) IND MOTHERBOARD CORE 2 DUO LGA775 ATX RoHS:否 制造商:Ampro By ADLINK 外觀尺寸:EPIC 處理器類型:Intel Atom D510 頻率:1.66 GHz 存儲(chǔ)容量:2 GB (max) 存儲(chǔ)類型:DDR2, L2 Cache 接口類型:Ethernet, PS/2, SATA, Serial, USB 工作電源電壓:5 V, 12 V 功耗:13 W 最大工作溫度:+ 70 C 尺寸:165.1 mm x 114.3 mm
M3220 功能描述:電纜固定件和配件 LTCG PG-16 GRAY With 3174 NUT RoHS:否 制造商:Heyco 類型:Cable Grips, Liquid Tight 材料:Nylon 顏色:Black 安裝方法:Cable 最大光束直徑:11.4 mm 抗拉強(qiáng)度:
M3220-3005-3005 制造商:RAF Electronic Hardware 功能描述:
M3220GAH 功能描述:安裝硬件 LTCG PG16 GRAY 3-5.6MM W/3174 RoHS:否 制造商:Harwin 類型:SMT Cable Clip 材料:Phosphor Bronze 安裝孔大小: 長度:5 mm 外徑: 內(nèi)徑: 厚度: 電鍍:Tin 螺紋大小:
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