參數(shù)資料
型號(hào)： AD9992BBCZRL
廠商： ANALOG DEVICES INC
元件分類： 消費(fèi)家電
英文描述： 12-Bit CCD Signal Processor with Precision Timing Generator
中文描述： SPECIALTY CONSUMER CIRCUIT, PBGA105
封裝： 8 X 8 MM, 0.65 MM PITCH, ROHS COMPLIANT, MO-225, CSPBGA-105
文件頁(yè)數(shù)： 34/92頁(yè)
文件大小： 718K
代理商： AD9992BBCZRL
AD9992
Rev. 0 | Page 34 of 92
V1
V2
V23
VLENA
VLENB
VLENC
VLEND
V-PATTERN A
V3
V-PATTERN B
V-PATTERN C
V-PATTERN D
NOTES
1. EACH SEGMENT MUST BE THE SAME LENGTH.
VLENA = VLENB = VLENC = VLEND.
0
Figure 38. Vertical Timing Divided Into Four Segments: VPATA, VPATB, VPATC, and VPATD
HD
COMBINED
V-PATTERN
NOTES
1. ABLE TO CONCATENATE PATTERNS TOGETHER ARBITRARILY.
2. EACH PATTERN CAN HAVE UP TO FOUR TOGGLES PROGRAMMED.
3. MAY CONCATENATE UP TO 18 PATTERNS INTO A MERGED PATTERN.
4. ODD AND EVEN LINES CAN HAVE A DIFFERENT PATTERN CONCATENATION
SPECIFIED BY VALTSEL EVEN AND ODD REGISTERS.
A B
B
D
A
C
C
A
B C
B
D
A
B
A
A
0
Figure 39. Concatenating Each VPAT Group in Arbitrary Order
NOTES
1. SIX V-PATTERN SEGMENTS CONCATENATED INTO A MERGED PATTERN.
2. COMMON AND REPETITIVE VTP SEGMENTS DERIVED FROM THE COMPLETE VTP PATTERN.
3. VALTSEL REGISTERS SPECIFY SEGMENT ORDER TO CREATE THE CONCATENATED MERGED PATTERN.
Figure 40. Example of Special V-Sequence Alternation Mode Using VALTSEL Registers to Specify Segment Order
A
C
B
D
V1
V2
V23
V3
VPATA
VPATC
VPATB
VPATD
VPATD
VPATA
VALTSEL0_EVEN
VALTSEL1_EVEN
0
0
0
1
1
0
1
1
1
1
0
0
SEGMENT 1
A
D
V1 TO V23
SEGMENT 2
SEGMENT 3
SEGMENT4
SEGMENT 5
SEGMENT 6
HD
0
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PDF描述
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