參數(shù)資料
型號(hào)： M7A3PE600-FPQG208I
元件分類： FPGA
英文描述： FPGA, 600000 GATES, PQFP208
封裝： 0.50 MM PITCH, GREEN, PLASTIC, QFP-208
文件頁數(shù)： 151/168頁
文件大小： 1335K
代理商： M7A3PE600-FPQG208I
ProASIC3E Flash Family FPGAs
A d v an c ed v0 . 5
3-15
Overview of I/O Performance
Summary of I/O DC Input and Output Levels – Default I/O Software Settings
Table 3-13 Summary of Maximum and Minimum DC Input and Output Levels Applicable to Commercial and Industrial
Conditions
I/O Standard
Drive
Strength
Slew
Rate
VIL
VIH
VOL
VOH
IOL
IOH
Min, V
Max, V
Min, V
Max, V
Min, V
mA
3.3 V LVTTL /
3.3 V LVCMOS
12 mA
High
–0.3
0.8
2
3.6
0.4
2.4
12
2.5 V LVCMOS
12 mA
High
–0.3
0.7
1.7
3.6
0.7
1.7
12
1.8 V LVCMOS
12 mA
High
–0.3
0.35 * VCCI 0.65 * VCCI
3.6
0.45
VCCI – 0.45
12
1.5 V LVCMOS
12 mA
High
–0.3
0.30 VCCI
0.7 * VCCI
3.6
0.25 * VCCI 0.75 * VCCI
12
3.3 V PCI
Per PCI Specification
3.3 V PCI-X
Per PCI-X Specification
3.3 V GTL
25 mA2
High
–0.3
VREF – 0.05 VREF + 0.05
3.6
0.4
–
25
2.5 V GTL
25 mA2
High
–0.3
VREF – 0.05 VREF + 0.05
3.6
0.4
–
25
3.3 V GTL+
35 mA
High
–0.3
VREF – 0.1
VREF + 0.1
3.6
0.6
–
51
2.5 V GTL+
33 mA
High
–0.3
VREF – 0.1
VREF + 0.1
3.6
0.6
–
40
HSTL (I)
8 mA
High
–0.3
VREF – 0.1
VREF + 0.1
3.6
0.4
VCCI – 0.4
8
HSTL (II)
15 mA2
High
–0.3
VREF – 0.1
VREF + 0.1
3.6
0.4
VCCI – 0.4
15
SSTL2 (I)
15 mA
High
–0.3
VREF – 0.2
VREF + 0.2
3.6
0.54
VCCI – 0.62
15
SSTL2 (II)
18 mA
High
–0.3
VREF – 0.2
VREF + 0.2
3.6
0.35
VCCI – 0.43
18
SSTL3 (I)
14 mA
High
–0.3
VREF – 0.2
VREF + 0.2
3.6
0.7
VCCI – 1.1
14
SSTL3 (II)
21 mA
High
–0.3
VREF – 0.2
VREF + 0.2
3.6
0.5
VCCI – 0.9
21
Notes:
1. Currents are measured at 85°C junction temperature.
2. Output drive strength is below JEDEC specification.
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PDF描述
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