- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄369715 > L80223 (LSI CORP) 10BASE-T/100BASE-TX/FX Ethernet Physical Layer Device (PHY)(10BASE-T/100BASE-TX/FX 以太網(wǎng)物理層處理器) PDF資料下載
參數(shù)資料
| 型號： | L80223 |
| 廠商： | LSI CORP |
| 元件分類： | 網(wǎng)絡(luò)接口 |
| 英文描述： | 10BASE-T/100BASE-TX/FX Ethernet Physical Layer Device (PHY)(10BASE-T/100BASE-TX/FX 以太網(wǎng)物理層處理器) |
| 中文描述： | DATACOM, ETHERNET TRANSCEIVER, PQFP64 |
| 封裝： | LQFP-64 |
| 文件頁數(shù)： | 50/192頁 |
| 文件大小： | 1306K |
| 代理商： | L80223 |
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Draft 6/5/00
2-30
Functional Description
Copyright 2000 by LSI Logic Corporation. All rights reserved.
2.2.10 Clock and Data Recovery
This section describes clock and data recovery methods implemented in
the device for both the 100 Mbits/s and 10 Mbits/s modes.
2.2.10.1 100 Mbits/s Clock and Data Recovery
Clock recovery is accomplished with a phase-locked-loop (PLL). If valid
data is not present on the receive inputs, the PLL is locked to the
25-MHz TX_CLK signal. When the squelch circuit detects valid data on
the receive TP input, and if the device is in the Link Pass state, the PLL
input is switched to the incoming data on the receive inputs. The PLL
then locks on to the transitions in the incoming signal to recover the
clock. The recovered data clock is then used to generate the 25 MHz
nibble clock, RX_CLK, which clocks data into the controller interface
section.
The recovered clock extracted by the PLL latches in data from the TP
receiver to perform data recovery. The data is then converted from a
single bit stream into nibble wide data words according to the format
shown in
Figure 2.3
2.2.10.2 10 Mbits/s Clock and Data Recovery
The clock recovery process for 10 Mbits/s mode is identical to the 100
Mbits/s mode except:
The recovered clock frequency is a 2.5 MHz nibble clock
The PLL is switched from TX_CLK to the TP input when the squelch
indicates valid data
The PLL takes up to 12 transitions (bit times) to lock onto the
preamble, so some of the preamble data symbols are lost. However,
the clock recovery block recovers enough preamble symbols to pass
at least six nibbles of preamble to the receive controller interface as
shown in
Figure 2.3
.
The data recovery process for 10 Mbits/s mode is identical to that of the
100 Mbits/s mode. As mentioned in the Manchester Decoder section, the
data recovery process inherently performs decoding of Manchester
encoded data from the TP inputs.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| L80600 | L80600 10/100/1000 Mbits/s Ethernet PHY technical manual 3/01 |
| L811-1X1T-03 | 1port.None LEDs.low profile RJ45 10/100Base-TX |
| L82-510 | Logic IC |
| L82-511 | Logic IC |
| L82-512 | Logic IC |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| L80223/A | 制造商:LSI Corporation 功能描述:PN may be NE DW |
| L80223/C | 制造商:LSI Corporation 功能描述:PN may be NE DW |
| L80223/D | 制造商:LSI Corporation 功能描述:PHY 1-CH 10Mbps/100Mbps 64-Pin LQFP |
| L80223/D-E6 | 制造商:LSI Corporation 功能描述:TRANSITION TO P/N 68032B1 - Bulk |
| L80223/D-LEADFREE | 制造商:LSI Corporation 功能描述: |
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