參數(shù)資料
型號: L80223
廠商: LSI CORP
元件分類: 網(wǎng)絡(luò)接口
英文描述: 10BASE-T/100BASE-TX/FX Ethernet Physical Layer Device (PHY)(10BASE-T/100BASE-TX/FX 以太網(wǎng)物理層處理器)
中文描述: DATACOM, ETHERNET TRANSCEIVER, PQFP64
封裝: LQFP-64
文件頁數(shù): 174/192頁
文件大?。?/td> 1306K
代理商: L80223
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Draft 6/5/00
A-14
Application Information
Copyright 2000 by LSI Logic Corporation. All rights reserved.
The 83-, 57-, and 68-ohm resistors on FXI+/
and SD/FXDISn are used
for 100-ohm termination and for biasing the 5V fiber optic transceiver
outputs to match the input range on the 3.3V device FX inputs. Place
these resistors as closely as possible on the PCB to the device FX
inputs. In addition, keep the parasitic loading on FXI+ and FXI
to a
minimum and matched as well as possible.
In the 5 V transceiver application, the SD_THR pin needs to be tied to
V
DD
1.3 V, which can be done with an external resistor divider as
shown in
Figure A.5
. The voltage on the SD_THR pin determines the
SD/FXDISn internal buffer ECL trip level. The SD/FXDISn internal buffer
trip level needs to be set to VDD
1.3 V and must be referenced to the
fiber optic transceiver 5 V supply. Using a resistor divider from the fiber
optic transceiver 5 V supply to generate the voltage for the SD_THR pin
references the SD/FXDISn ECL trip level to the transceiver 5 V supply.
This allows the device SD/FXDISn internal buffer ECL trip level to track
the supply variations of the fiber optic transceiver, allowing direct
connection of the fiber optic transceiver signal detect output to the device
SD/FXDISn input, as shown in
Figure A.5
.
A.8.3 Disabling the FX Interface
Connecting the SD/FXDISn pin to GND disables the FX interface. When
the FX interface is disabled, the TP interface is enabled, and vice versa.
相關(guān)PDF資料
PDF描述
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