- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄369715 > L80223 (LSI CORP) 10BASE-T/100BASE-TX/FX Ethernet Physical Layer Device (PHY)(10BASE-T/100BASE-TX/FX 以太網(wǎng)物理層處理器) PDF資料下載
參數(shù)資料
| 型號： | L80223 |
| 廠商： | LSI CORP |
| 元件分類： | 網(wǎng)絡(luò)接口 |
| 英文描述： | 10BASE-T/100BASE-TX/FX Ethernet Physical Layer Device (PHY)(10BASE-T/100BASE-TX/FX 以太網(wǎng)物理層處理器) |
| 中文描述： | DATACOM, ETHERNET TRANSCEIVER, PQFP64 |
| 封裝： | LQFP-64 |
| 文件頁數(shù)： | 179/192頁 |
| 文件大?。?/td> | 1306K |
| 代理商： | L80223 |
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Draft 6/5/00
Serial Port
A-19
Copyright 2000 by LSI Logic Corporation. All rights reserved.
An external device can use the interrupt indications to initiate a read
cycle. When an interrupt is detected, the individual registers (or multiple
registers) can be read out and the status bits compared against their
previous values to determine any changes. After the interrupt bits have
been read out, the interrupt signals are automatically deasserted.
A mask register bit exists for every status output bit in the MI serial port
Interrupt Mask register so that the interrupt bits can be individually
programmed for each application.
A.11.2 Multiple Register Access
If the MI serial port needs to be constantly polled in order to monitor
changes in status output bits, or if it is desired that all registers be read
or written in a single serial port access cycle, multiple register access
mode can be used. Multiple register access allows access to all registers
in a single MI serial port access cycle. When multiple register access is
enabled, all the registers are read or written when the register address
REGAD[4:0] = 0b11111. This eliminates the need to read or write
registers individually. Multiple register access mode is normally disabled.
To enable it, set the Multiple Register Access Enable (MREG) bit in the
MI serial port Configuration 2 register.
A.11.3 Serial Port Addressing
Tying the MDA[4:0]n pins to the desired value selects the device address
for the MI serial port. MDA[4:0]n share the same pins as the LED
outputs, as shown in
Figure A.7
a. At powerup or reset, the output drivers
are 3-stated for an interval called the power-on reset time. During the
power-on reset interval, the value on these pins is latched into the
device, inverted, and used as the MI serial port address. The LED
outputs are open-drain with internal pullup to V
DD
.
If an LED is to be connected on an LED output, an LED and resistor are
tied to V
DD
as shown in
Figure A.6
b. If a HIGH address is desired, the
LED to V
DD
automatically makes the latched address value a HIGH. If a
LOW value for the address is desired, a 50 K
resistor to GND must be
added as shown in
Figure A.6
b.
If no LEDs are needed on the LED outputs, the selection of addresses
can be done as shown in
Figure A.6
c. If a HIGH address is desired, the
pin should be left floating and the internal pullup pulls the pin HIGH
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| L80600 | L80600 10/100/1000 Mbits/s Ethernet PHY technical manual 3/01 |
| L811-1X1T-03 | 1port.None LEDs.low profile RJ45 10/100Base-TX |
| L82-510 | Logic IC |
| L82-511 | Logic IC |
| L82-512 | Logic IC |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| L80223/A | 制造商:LSI Corporation 功能描述:PN may be NE DW |
| L80223/C | 制造商:LSI Corporation 功能描述:PN may be NE DW |
| L80223/D | 制造商:LSI Corporation 功能描述:PHY 1-CH 10Mbps/100Mbps 64-Pin LQFP |
| L80223/D-E6 | 制造商:LSI Corporation 功能描述:TRANSITION TO P/N 68032B1 - Bulk |
| L80223/D-LEADFREE | 制造商:LSI Corporation 功能描述: |
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