- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄369715 > L80223 (LSI CORP) 10BASE-T/100BASE-TX/FX Ethernet Physical Layer Device (PHY)(10BASE-T/100BASE-TX/FX 以太網(wǎng)物理層處理器) PDF資料下載
參數(shù)資料
| 型號： | L80223 |
| 廠商： | LSI CORP |
| 元件分類： | 網(wǎng)絡(luò)接口 |
| 英文描述： | 10BASE-T/100BASE-TX/FX Ethernet Physical Layer Device (PHY)(10BASE-T/100BASE-TX/FX 以太網(wǎng)物理層處理器) |
| 中文描述： | DATACOM, ETHERNET TRANSCEIVER, PQFP64 |
| 封裝： | LQFP-64 |
| 文件頁數(shù)： | 169/192頁 |
| 文件大小： | 1306K |
| 代理商： | L80223 |
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Draft 6/5/00
Transmitter Droop
A-9
Copyright 2000 by LSI Logic Corporation. All rights reserved.
to TPO .Each value for RTERM on the TPI inputs is for the sum of the
four series resistors across TPI ,as shown in
Figure A.1
–
Figure A.3
.
These resistors should be 1% tolerance. Also note that some output level
adjustment may be necessary due to parasitics as described in
Section
A.4, “TP Transmit Output Current Set,” page A-7
.
IEEE 802.3 specifies that 10BASE-T and 100BASE-TX operate over
twisted-pair cable lengths of between 0–100 meters. The squelch levels
can be reduced by 4.5 dB if the Receive Input Level Adjust bit (RLVL0)
is set in the MI serial port Configuration 1 register. This allows the
L80223 to operate with up to 150 meters of twisted-pair cable. The
equalizer is already designed to accommodate between 0–125 meters of
cable.
A.6 Transmitter Droop
The IEEE 802.3 specification has a transmit output droop requirement for
100BASE-TX. Because the L80223 TP output is a current source, it has
no perceptible droop by itself. However, the inductance of the transformer
added to the device transmitter output as shown in
Figure A.1
through
Figure A.3
causes droop to appear at the transmit interface to the TP
wire. If the transformer connected to the L80223 outputs meets the
requirements of
Table A.1
, the transmit interface to the TP cable then
meets the IEEE 802.3 droop requirements.
A.7 Automatic JAM
The L80223 has an automatic JAM generation feature that automatically
transmits a JAM packet when receive activity is detected. This feature is
primarily designed to give the user a means to easily implement
half-duplex flow control. In a typical application, a watermark signal from
a system FIFO or memory is be tied directly to the JAMn pin. When the
system FIFO is nearly full and more data is being received, the device
automatically transmits a JAM packet and creates a collision, which
causes the far end device to back off, allowing time for the system FIFO
to empty itself.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| L80600 | L80600 10/100/1000 Mbits/s Ethernet PHY technical manual 3/01 |
| L811-1X1T-03 | 1port.None LEDs.low profile RJ45 10/100Base-TX |
| L82-510 | Logic IC |
| L82-511 | Logic IC |
| L82-512 | Logic IC |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| L80223/A | 制造商:LSI Corporation 功能描述:PN may be NE DW |
| L80223/C | 制造商:LSI Corporation 功能描述:PN may be NE DW |
| L80223/D | 制造商:LSI Corporation 功能描述:PHY 1-CH 10Mbps/100Mbps 64-Pin LQFP |
| L80223/D-E6 | 制造商:LSI Corporation 功能描述:TRANSITION TO P/N 68032B1 - Bulk |
| L80223/D-LEADFREE | 制造商:LSI Corporation 功能描述: |
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