- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄369715 > L80223 (LSI CORP) 10BASE-T/100BASE-TX/FX Ethernet Physical Layer Device (PHY)(10BASE-T/100BASE-TX/FX 以太網(wǎng)物理層處理器) PDF資料下載
參數(shù)資料
| 型號： | L80223 |
| 廠商： | LSI CORP |
| 元件分類： | 網(wǎng)絡(luò)接口 |
| 英文描述： | 10BASE-T/100BASE-TX/FX Ethernet Physical Layer Device (PHY)(10BASE-T/100BASE-TX/FX 以太網(wǎng)物理層處理器) |
| 中文描述： | DATACOM, ETHERNET TRANSCEIVER, PQFP64 |
| 封裝： | LQFP-64 |
| 文件頁數(shù)： | 178/192頁 |
| 文件大?。?/td> | 1306K |
| 代理商： | L80223 |
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Draft 6/5/00
A-18
Application Information
Copyright 2000 by LSI Logic Corporation. All rights reserved.
A.11 Serial Port
The L80223 uses an MI serial port to access the device registers. Any
external device that has a IEEE 802.3 compliant MI interface can connect
directly to the L80223 without any glue logic, as shown in
Figure A.1
through
Figure A.3
.
As described earlier, the MI serial port consists of eight signals: MDC,
MDIO, MDINTn, and MDA[4:0]n. However, only two signals, MDC and
MDIO, are needed to shift data in and out. MDA[4:0]n are not needed,
but are provided for convenience only.
Note that the MDA[4:0]n addresses are inverted inside the L80223 before
going to the MI serial port block. This means that the MDAn[4:0] pins
would have to be pin strapped to 0b11111 externally to successfully
match the MI physical address of 0b0000 on the PHYAD[4:0] bits
internally.
A.11.1 Polling and Interrupt
The device status bits can be monitored in one of two ways:
Polling the serial port, or
Responding to interrupts
The polling method reads the registers at regular intervals and compares
the status bits to their previous values to determine any changes. To
make polling simpler, all the registers can be accessed in a single read
or write cycle. To do this, set the register address bits REGAD[4:0] to
0b11111 and add enough clocks to read out all the bits (provided the
multiple register access feature has been enabled).
The interrupt feature detects changes in the status output bits without
register polling. When the device asserts an interrupt, it indicates that
one or more of the status output bits has changed since the last read
cycle. There are three interrupt output indicators on the device:
MDINTn pin assertion
Interrupt pulse on MDIO
INT bit set in the MI serial port Status Output register.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| L80600 | L80600 10/100/1000 Mbits/s Ethernet PHY technical manual 3/01 |
| L811-1X1T-03 | 1port.None LEDs.low profile RJ45 10/100Base-TX |
| L82-510 | Logic IC |
| L82-511 | Logic IC |
| L82-512 | Logic IC |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| L80223/A | 制造商:LSI Corporation 功能描述:PN may be NE DW |
| L80223/C | 制造商:LSI Corporation 功能描述:PN may be NE DW |
| L80223/D | 制造商:LSI Corporation 功能描述:PHY 1-CH 10Mbps/100Mbps 64-Pin LQFP |
| L80223/D-E6 | 制造商:LSI Corporation 功能描述:TRANSITION TO P/N 68032B1 - Bulk |
| L80223/D-LEADFREE | 制造商:LSI Corporation 功能描述: |
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