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參數(shù)資料
| 型號： | FW82815 |
| 英文描述： | Controller Miscellaneous - Datasheet Reference |
| 中文描述： | 控制器雜項-數(shù)據(jù)表參考 |
| 文件頁數(shù)： | 79/172頁 |
| 文件大?。?/td> | 795K |
| 代理商： | FW82815 |
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82815 GMCH
R
Datasheet
79
3.4.34.
AMTT—AGP Multi-Transaction Timer
(Device 0: AGP Mode Only)
Address Offset:
Default Value:
Access:
Size:
BCh
00h
Read/Write
8 bits
AMTT controls the amount of time that the GMCH’s arbiter allows AGP/PCI master to perform multiple
back-to-back transactions. The GMCH’s AMTT mechanism is used to optimize the performance of the
AGP master (using PCI semantics) that performs multiple back-to-back transactions to fragmented
memory ranges (and as a consequence it can not use long burst transfers). The AMTT mechanism applies
to the processor — AGP/PCI transactions as well and it guarantees to the processor a fair share of the
AGP/PCI interface bandwidth.
The number of clocks programmed in the AMTT represents the guaranteed time slice (measured in
66 MHz clocks) allotted to the current agent (either AGP/PCI master or Host bridge) after which the
AGP arbiter grants the bus to another agent. The default value of AMTT is 00h and disables this
function. The AMTT value can be programmed with 8-clock granularity. For example, if the AMTT is
programmed to 18h, the selected value corresponds to the time period of 24 AGP (66 MHz) clocks.
7
3
2
0
Multi-Transaction Timer Count Value
Reserved
Bit
Description
7:3
Multi-Transaction Timer Count Value.
The number programmed in these bits represents the
guaranteed time slice (measured in eight 66 MHz clock granularity) allotted to the current agent (either
AGP/PCI master or Host bridge) after which the AGP arbiter will grant the bus to another agent.
2:0
Reserved.
相關(guān)PDF資料 |
PDF描述 |
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| FWA-35A21F | Fuse |
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