參數(shù)資料
型號(hào)： ADUC7034BCPZ-RL
廠商： Analog Devices Inc
文件頁(yè)數(shù)： 69/136頁(yè)
文件大小： 0K
描述： IC MCU FLASH 32K ANLG IO 48LFCSP
標(biāo)準(zhǔn)包裝： 2,500
系列： MicroConverter® ADuC7xxx
核心處理器： ARM7
芯體尺寸： 16/32-位
速度： 20.48MHz
連通性： LIN，SPI，UART/USART
外圍設(shè)備： POR，PSM，溫度傳感器，WDT
輸入/輸出數(shù)： 9
程序存儲(chǔ)器容量： 32KB（16K x 16）
程序存儲(chǔ)器類(lèi)型： 閃存
RAM 容量： 1K x 32
電壓 - 電源 (Vcc/Vdd)： 3.5 V ~ 18 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 2x16b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 115°C
封裝/外殼： 48-VFQFN 裸露焊盤(pán)，CSP
包裝： 帶卷 (TR)
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ADuC7034
Rev. B | Page 38 of 136
Table 26. STI Base Address = 0xFFFF0880
Address
Name
Byte
Access
Type
Default Value
Description
0x0880
STIKEY0
4
W
N/A
STICON prewrite key. See the Serial Test Interface Key0 Register section.
0x0884
STICON
2
RW
0x0000
Serial test interface control MMR. See the Serial Test Interface Control Register
section and Table 90.
0x0888
STIKEY1
4
W
N/A
STICON postwrite key. See the Serial Test Interface Key1 Register section and
0x088C
STIDAT0
2
RW
0x0000
STI Data MMR 0. See the Serial Test Interface Data0 Register section.
0x0890
STIDAT1
2
RW
0x0000
STI Data MMR 1. See the Serial Test Interface Data1 Register section.
0x0894
STIDAT2
2
RW
0x0000
STI Data MMR 2. See the Serial Test Interface Data2 Register section.
Table 27. SPI Base Address = 0xFFFF0A00
Address
Name
Byte
Access Type
Default Value
Description
0x0A00
SPISTA
1
R
0x00
SPI status MMR. See the SPI Status Register section and Table 89.
0x0A04
SPIRX
1
R
0x00
SPI receive MMR. See the SPI Receive Register section.
0x0A08
SPITX
1
W
SPI transmit MMR. See the SPI Transmit Register section.
0x0A0C
SPIDIV
1
RW
0x1B
SPI baud rate select MMR. See the SPI Divider Register section.
0x0A10
SPICON
2
RW
0x00
SPI control MMR. See the SPI Control Register section and Table 88.
Table 28. GPIO Base Address = 0xFFFF0D00
Address
Name
Byte
Access
Type
Default Value
Description
0x0D00
GP0CON
4
RW
0x11100000
GPIO Port0 control MMR. See the GPIO Port0 Control Register section and
0x0D04
GP1CON
4
RW
0x10000000
GPIO Port1 control MMR. See the GPIO Port1 Control Register section and
0x0D08
GP2CON
4
RW
0x01000000
GPIO Port2 control MMR. See the GPIO Port2 Control Register section and
0x0D20
GP0DAT1
RW
0x000000XX
GPIO Port0 data control MMR. See the GPIO Port0 Data Register section and
0x0D24
GP0SET
4
W
GPIO Port0 data set MMR. See the GPIO Port0 Set Register section and
0x0D28
GP0CLR
4
W
GPIO Port0 data clear MMR. See the GPIO Port0 Clear Register section and
0x0D30
GP1DAT1
4
RW
0x000000XX
GPIO Port1 data control MMR. See the GPIO Port1 Data Register section and
0x0D34
GP1SET
4
W
GPIO Port1 data set MMR. See the GPIO Port1 Set Register section and
0x0D38
GP1CLR
4
W
GPIO Port1 data clear MMR. See the GPIO Port1 Clear Register section and
0x0D40
GP2DAT1
4
RW
0x000000XX
GPIO Port2 Data Control MMR. See the GPIO Port2 Data Register section and
0x0D44
GP2SET
4
W
GPIO Port2 data set MMR. See the GPIO Port2 Set Register section and
0x0D48
GP2CLR
4
W
GPIO Port2 data clear MMR. See the GPIO Port2 Clear Register section and
1 Depends on the level on the external GPIO pins.
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PDF描述
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