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參數(shù)資料
| 型號： | PFR4200MAE40 |
| 廠商： | 飛思卡爾半導(dǎo)體(中國)有限公司 |
| 英文描述： | FlexRay Communication Controllers |
| 中文描述： | FlexRay通信控制器 |
| 文件頁數(shù)： | 178/260頁 |
| 文件大小： | 1782K |
| 代理商： | PFR4200MAE40 |
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MFR4200 FlexRay Communication Controller
MFR4200 Data Sheet, Rev. 0
178
Freescale Semiconductor
IFLG
BUFCMT
VALID (depending on the TT bit of the BUFCSnR register — see
Section 3.4.1, “Message Buffer
Control, Configuration and Status Register
)
Dynamic segment
In the dynamic segment, if several valid frames are pending within the interface, the frame with the highest
priority (lowest frame ID) is selected next.
The CC transmission procedure is described in detail in the frame processing section of the PWD
document. The most important points are as follows.
In the dynamic segment, different minislot sequences are possible on both channels (concurrent
sending of different IDx on both channels).
Pending frames are selected in accordance with their identifier and their filter configuration.
Frames overlapping with the network idle time (NIT), defined by the NITCR (see
Section 3.2.3.3.18, “Network Idle Time Configuration Register (NITCR)
”), will be not
transmitted.
If there are two or more transmit message buffers with the same identifier, the message buffer with
the lowest number wins the internal arbitration and will be transmitted; the remaining message
buffer(s) with matching filters will be removed from the arbitration process until the next
communication cycle.
If a message buffer was committed for transmission (BUFCMT= 1) it becomes valid (VALID = 1)
after the buffer unlock operation. The host cannot lock it until it is transmitted; this prevents
changing of a message buffer’s fields, while it is waiting to be transmitted.
Only valid frames (VALID bit = 1) can be transmitted by the CC.
Only identifiers that are higher than the highest static identifier are allowed for the dynamic
segment.
If there are valid frames with the same frame ID, the CC must check their filter fields. If two or
more of them match the conditions of the transmit slot, the message buffer with the lowest address
wins the internal arbitration.
The CC does not transmit null frames in the dynamic segment.
If two message buffers are assigned to the same dynamic slot but to different transmission channels,
the CC transmits them on the same minislot number and assigned channels during transmission of
that dynamic slot.
The CC changes the following bits if the message buffer has been sent.
1. IFLG
2. BUFCMT
3. VALID (depending on the TT bit of the BUFCSnR register — see
Section 3.4.1, “Message Buffer
Control, Configuration and Status Register
)
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| PFR4200MPB40 | FlexRay Communication Controllers |
| PFR850S | FAST RECOVERY RECTIFIER DIODES |
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參數(shù)描述 |
|---|---|
| PFR4200MPB40 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:FlexRay Communication Controllers |
| PFR4310E1MAE40 | 制造商:Freescale Semiconductor 功能描述: |
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| PFR5 102J630J11L4 | 制造商:Evox Rifa / KEMET 功能描述:PULSE CAP 0.001UF 630VDC |
| PFR5 102J63J11L4 | 制造商:Evox Rifa / KEMET 功能描述:PULSE CAP 0.001UF 63VDC |
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