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參數(shù)資料
| 型號： | PFR4200MAE40 |
| 廠商： | 飛思卡爾半導體(中國)有限公司 |
| 英文描述： | FlexRay Communication Controllers |
| 中文描述： | FlexRay通信控制器 |
| 文件頁數(shù)： | 165/260頁 |
| 文件大?。?/td> | 1782K |
| 代理商： | PFR4200MAE40 |
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Message Buffer Handling and Operations
MFR4200 Data Sheet, Rev. 0
Freescale Semiconductor
165
Locking errors:
Refer to
Section 3.2.3.6.3, “CHI Error Register (CHIER)
” for a detailed description. The most important
points are as follows.
If the controller receives two frames for a receive message buffer that is locked by the host, the
controller discards the older frame and sets the frame lost error FLE in the CHIER register.
A message buffer committed for transmission (its BUFCMT bit is ‘1’) cannot be locked. If the host
sends a lock request for the committed transmit message buffer, a lock error is raised.
The host cannot access the odd buffers (CC part buffers) of the double transmit message buffers. If
it sends a locking request for any odd buffer of a double transmit message buffer, a lock error is
raised.
If the host tries to lock a second transmit or receive buffer or a second FIFO buffer, the controller
issues a lock error. See the description of the RBLE, TBLE, FBLE bits in
Section 3.2.3.6.3, “CHI
Error Register (CHIER)
”.
NOTE
The host can write the BUFCMT bit of a message buffer only after the buffer
is locked and available through an active buffer. The BUFCMT bit is part of
the message buffer control, configuration, and status registers
BUFCSnR[0:58] (see
Section 3.4.1, “Message Buffer Control,
Configuration and Status Register
”).
Locking timing:
If a transmit message buffer (single or double) was committed for transmission in slot n and unlocked by
the host, and if the CC has scheduled this buffer for transmission in slot n, then this buffer is locked by the
CC for transmission (see the BB bit description in
Section 3.2.3.6.3, “CHI Error Register (CHIER)
”) for
the time shown in
Figure 3-133
.
Figure 3-133. Buffer Busy Bit Timing for a Transmit Message Buffer
slot n
slot n-1
NIT
communication cycle
TX Buffer Locking (Slot ID = n)
locking impossible
1
locking possible
locking possible
4 μT
4 μT
1
If the host issues a lock request here, the CC does not grant the lock request, but sets the BB flag
in the CHIER register indicating a transmit message buffer busy lock error.
相關PDF資料 |
PDF描述 |
|---|---|
| PFR4200MPB40 | FlexRay Communication Controllers |
| PFR850S | FAST RECOVERY RECTIFIER DIODES |
| PFR851S | FAST RECOVERY RECTIFIER DIODES |
| PFR852S | FAST RECOVERY RECTIFIER DIODES |
| PFR853S | FAST RECOVERY RECTIFIER DIODES |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| PFR4200MPB40 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:FlexRay Communication Controllers |
| PFR4310E1MAE40 | 制造商:Freescale Semiconductor 功能描述: |
| PFR4KR100E | 制造商:OHMITE 制造商全稱:Ohmite Mfg. Co. 功能描述:Powr-Rib Edgewound Edgewound and Round Wire |
| PFR5 102J630J11L4 | 制造商:Evox Rifa / KEMET 功能描述:PULSE CAP 0.001UF 630VDC |
| PFR5 102J63J11L4 | 制造商:Evox Rifa / KEMET 功能描述:PULSE CAP 0.001UF 63VDC |
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