參數(shù)資料
型號(hào)： OMAP5910(RISC)
英文描述： Dual-Core Processor
中文描述： 雙核處理器
文件頁數(shù)： 113/160頁
文件大?。?/td> 1997K
代理商： OMAP5910(RISC)
Functional Overview
101
August 2002 Revised August 2003
SPRS197B
Table 374. DSP Level 1 Interrupt Mappings
INTERRUPT
DSP
INTERRUPT
DSP
IFR/IMR
REGISTER
BIT
VECTOR
LOCATION
(BYTE
ADDRESS)
PRIORITY
FUNCTION
RESET
FFF00h
0
DSP Reset Interrupt
NMI
FFF08h
1
DSP Nonmaskable Interrupt
EMULATOR_TEST
INT2
2
FFF10h
3
DSP Emulator/Test Interrupt
LEVEL2_INTH_FIQ
INT3
3
FFF18h
5
FIQ Interrupt from DSP Level 2
Handler
TC_ABORT
INT4
4
FFF20h
6
Traffic Controller Abort Interrupt
MAILBOX_1 (ARM2DSP1)
INT5
5
FFF28h
7
MPU-to-DSP Mailbox 1 Interrupt
Reserved
INT6
6
FFF30h
9
Unused, keep masked
GPIO
INT7
7
FFF38h
10
Interrupt for DSP-owned Shared
GPIO
TIMER3
INT8
8
FFF40h
11
DSP Timer 3 Interrupt
DMA_CHANNEL_1
INT9
9
FFF48h
13
DSP DMA Channel 1 Interrupt
MPU
INT10
10
FFF50h
14
MPU Interrupt to DSP
Reserved
INT11
11
FFF58h
15
Unused, keep masked
UART3
INT12
12
FFF60h
17
UART Interrupt
WDGTIMER
INT13
13
FFF68h
18
DSP Watchdog Timer Interrupt
DMA_CHANNEL_4
INT14
14
FFF70h
21
DSP DMA Channel 4 Interrupt
DMA_CHANNEL_5
INT15
15
FFF78h
22
DSP DMA Channel 5 Interrupt
EMIF
INT16
16
FFF80h
4
Interrupt for DMA EMIF interface to
Traffic Controller
LOCAL_BUS
INT17
17
FFF88h
8
Local Bus Interrupt
DMA_CHANNEL_0
INT18
18
FFF90h
12
DSP DMA Channel 0 Interrupt
MAILBOX2 (ARM2DSP2)
INT19
19
FFF98h
16
MPU-to-DSP Mailbox 2 Interrupt
DMA_CHANNEL_2
INT20
20
FFFA0h
19
DSP DMA Channel 2 Interrupt
DMA_CHANNEL_3
INT21
21
FFFA8h
20
DSP DMA Channel 3 Interrupt
TIMER2
INT22
22
FFFB0h
23
DSP Timer 2 Interrupt
TIMER1
INT23
23
FFFB8h
24
DSP Timer 1 Interrupt
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PDF描述
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