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參數(shù)資料
| 型號： | MPC5125YVN400 |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 68/94頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MCU 32BIT E300 324TEPBGA |
| 標(biāo)準(zhǔn)包裝： | 60 |
| 系列： | MPC51xx |
| 核心處理器： | e300 |
| 芯體尺寸： | 32-位 |
| 速度： | 400MHz |
| 連通性： | CAN，EBI/EMI，以太網(wǎng)，I²C，USB OTG |
| 外圍設(shè)備： | DMA，WDT |
| 輸入/輸出數(shù)： | 64 |
| 程序存儲器類型： | ROMless |
| RAM 容量： | 32K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 1.08 V ~ 3.6 V |
| 振蕩器型： | 外部 |
| 工作溫度： | -40°C ~ 125°C |
| 封裝/外殼： | 324-BBGA |
| 包裝： | 托盤 |
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MPC5125 Microcontroller Data Sheet, Rev. 4
Electrical and Thermal Characteristics
Freescale Semiconductor
70
Figure 34. TFT LCD Interface Timing Diagram — Horizontal Sync Pulse
Figure 35 depicts the vertical timing (timing of one frame), including the vertical sync pulse and the data. All parameters shown
in the diagram are programmable.
Figure 35. TFT LCD Interface Timing Diagram — Vertical Sync Pulse
Table 35 shows timing parameters of signals.
Table 35. LCD Interface Timing Parameters — Pixel Level
Sym
Description
Value
Unit
SpecID
tPCP
Display Pixel Clock Period
151
ns
A15.1
tPWH
HSYNC Pulse Width
PW_H
t
PCP
ns
A15.2
tBPH
HSYNC Back Porch Width
BP_H
t
PCP
ns
A15.3
1
2
3
DELTA_X
tPWH
tBPH
tSW
tFPH
DIU_CLK
DIU_LD[23:0]
DIU_HSYNC
DIU_DE
tPCP
1
Invalid Data
Start of line
tHSP
1
2
3
DELTA_Y
tPWV
tBPV
tSH
tFPV
DIU_HSYNC
DIU_LD[23:0]
DIU_VSYNC
DIU_DE
tHSP
1
(Line Data)
Start of Frame
Invalid Data
tVSP
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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