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參數(shù)資料
| 型號： | MPC5125YVN400 |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 53/94頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MCU 32BIT E300 324TEPBGA |
| 標準包裝： | 60 |
| 系列： | MPC51xx |
| 核心處理器： | e300 |
| 芯體尺寸： | 32-位 |
| 速度： | 400MHz |
| 連通性： | CAN，EBI/EMI，以太網(wǎng)，I²C，USB OTG |
| 外圍設(shè)備： | DMA，WDT |
| 輸入/輸出數(shù)： | 64 |
| 程序存儲器類型： | ROMless |
| RAM 容量： | 32K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 1.08 V ~ 3.6 V |
| 振蕩器型： | 外部 |
| 工作溫度： | -40°C ~ 125°C |
| 封裝/外殼： | 324-BBGA |
| 包裝： | 托盤 |
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Electrical and Thermal Characteristics
MPC5125 Microcontroller Data Sheet, Rev. 4
Freescale Semiconductor
57
4.3.6.1
Non-MUXed Mode
4.3.6.1.1
Non-MUXed Non-Burst Mode
Figure 14. Timing Diagram — Non-MUXed non-Burst Mode
t19 Non-MUXed mode page burst: ADDR cycle
tLPCck – tOD
tLPCck
ns
A7.20
t20 Non-MUXed mode page burst: burst DATA
(rd) input setup before next ADDR cycle
tOD + t6
—
ns
A7.21
t21 Non-MUXed mode page burst: burst DATA
(rd) input hold after next ADDR cycle
0—
ns
A7.22
t22 MUXed mode: non-burst CS[x] pulse width
(ALT × (AL
2) + WS)
×
t
LPCck
(ALT × (AL
2) + WS)
×
t
LPCck
ns
A7.23
t23 MUXed mode: read-burst CS[x] pulse
width
(ALT × (AL
2) + WS) +
BBT/DS) ×
t
LPCck
(ALT × (AL
2) + WS) +
BBT/DS) ×
t
LPCck
ns
A7.23
t24 MUXed mode: write-burst CS[x] pulse
width
(ALT × (AL
2) + 2.5 WS) +
BBT/DS)×
t
LPCck
(ALT × (AL
2) + 2.5 WS) +
BBT/DS)×
t
LPCck
ns
A7.23
Table 25. LPC Timing (continued)
Sym
Description
Min
Max
Units
SpecID
ADDR
DATA (rd)
CS[x]
R/W
DATA (wr)
OE
t6
t7
TS
TSIZ[1:0]
ACK
t1
LPC CLK
t4
tLPCck
t2
t3
t5
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MPC5125YVN400 | 制造商:Freescale Semiconductor 功能描述:ICMICROPROCESSOR32-BITCMOSPBGA324PI |
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