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參數(shù)資料
| 型號： | M7A3PE600-FFG484I |
| 元件分類： | FPGA |
| 英文描述： | FPGA, 600000 GATES, PBGA484 |
| 封裝： | 1 MM PITCH, FBGA-484 |
| 文件頁數(shù)： | 110/168頁 |
| 文件大小： | 1335K |
| 代理商： | M7A3PE600-FFG484I |
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ProASIC3E Flash Family FPGAs
2- 34
Advanced v0.5
Double Data Rate (DDR) Support
ProASIC3E devices support 350 MHz DDR inputs and
outputs. In DDR mode, new data is present on every
transition of the clock signal. Clock and data lines have
identical bandwidths and signal integrity requirements,
making them very efficient for implementing very high-
speed systems.
DDR interfaces can be implemented using HSTL, SSTL,
LVDS, and LVPECL I/O standards. The DDR feature is
primarily implemented in the FPGA core periphery and is
not tied to a specific I/O technology or limited to any I/O
standards.
Input Support for DDR
The basic structure to support a DDR input is shown in
Figure 2-24. Three input registers are used to capture
incoming data, which is presented to the core on each
rising edge of the I/O register clock.
Each I/O tile on ProASIC3E devices supports DDR inputs.
Output Support for DDR
The basic DDR output structure is shown in Figure 2-25
on page 2-35. New data is presented to the output every
half clock cycle. Note: DDR macros and I/O registers do
not
require
additional
routing.
The
combiner
automatically recognizes the DDR macro and pushes its
registers to the I/O register area at the edge of the chip.
The routing delay from the I/O registers to the I/O buffers
is already taken into account in the DDR macro.
Refer to the Actel application note Using DDR for
ProASIC3/E Devices for more information.
Figure 2-24 DDR Input Register Support in ProASIC3E Devices
Input DDR
Data
CLK
CLKBUF
INBUF
Out_QF
(to core)
FF2
FF1
INBUF
CLR
DDR_IN
X
E
A
B
C
D
Out_QR
(to core)
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| M7A3PE600-FFGG256I | FPGA, 600000 GATES, PBGA256 |
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參數(shù)描述 |
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| M7AFS600-1FG256I | 制造商:Microsemi Corporation 功能描述:FPGA FUSION 600K GATES 1282.05MHZ 130NM 1.5V 256FBGA - Trays 制造商:Microsemi SOC Products Group 功能描述:FPGA FUSION 600K GATES 1282.05MHZ 130NM 1.5V 256FBGA - Trays |
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