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參數(shù)資料
| 型號： | ADV7311KST |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 47/84頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC VID ENC 6-12BIT DAC'S 64LQFP |
| 產(chǎn)品變化通告： | ADV7xxx Obsolescence 16/Jan/2012 |
| 標準包裝： | 1 |
| 類型： | 視頻編碼器 |
| 應(yīng)用： | DVD，SD/HD |
| 電壓 - 電源，模擬： | 2.5V |
| 電壓 - 電源，數(shù)字： | 2.5V |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 64-LQFP |
| 供應(yīng)商設(shè)備封裝： | 64-LQFP（14x14） |
| 包裝： | 托盤 |
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REV. A
ADV7310/ADV7311
–51–
Adaptive Filter Control Application
Figures 45 and 46 show typical signals to be processed by the
adaptive filter control block.
: 692mV
@: 446mV
: 332ns
@: 12.8ms
Figure 45. Input Signal to Adaptive Filter Control
: 692mV
@: 446mV
: 332ns
@: 12.8ms
Figure 46. Output Signal after Adaptive Filter Control
The following register settings were used to obtain the results
shown in Figure 46, i.e., to remove the ringing on the Y signal.
Input data was generated by an external signal source.
When changing the adaptive filter mode to Mode B [Address 15h,
Bit 6], the following output can be obtained:
: 674mV
@: 446mV
: 332ns
@: 12.8ms
Figure 47. Output Signal from Adaptive Filter Control
The adaptive filter control can also be demonstrated using the
internally generated cross hatch test pattern and toggling the
adaptive filter control bit [Address 15h, Bit 7].
Table XV.
Address
Register Setting
00h
FCh
01h
38h
02h
20h
10h
00h
11h
85h
15h
80h
20h
00h
38h
ACh
39h
9Ah
3Ah
88h
3Bh
28h
3Ch
3Fh
3Dh
64h
Table XIV.
Address
Register Setting
00h
FCh
01h
38h
02h
20h
10h
00h
11h
81h
15h
80h
20h
00h
38h
ACh
39h
9Ah
3Ah
88h
3Bh
28h
3Ch
3Fh
3Dh
64h
All other registers are set as normal/default.
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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