參數(shù)資料
型號： 5AGXMB3G6F31C6NES
廠商： Altera
文件頁數(shù)： 32/124頁
文件大?。?/td> 0K
描述： IC ARRIA V FPGA 362K 896FBGA
標(biāo)準(zhǔn)包裝： 3
系列： Arria V GX
LAB/CLB數(shù)： 17110
邏輯元件/單元數(shù)： 362730
RAM 位總計(jì)： 2148352
輸入/輸出數(shù)： 384
電源電壓： 1.07 V ~ 1.13 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 85°C
封裝/外殼： 896-BGA
供應(yīng)商設(shè)備封裝： 896-FBGA（31x31）
其它名稱： 544-2735
Electrical Characteristics
Page 13
February 2014
Altera Corporation
Arria V GX, GT, SX, and ST Device Datasheet
1.2 V
1.14
1.2
1.26
–0.3
0.35 x VCCIO
0.65 x
VCCIO
VCCIO + 0.3
0.25 x VCCIO
0.75 x VCCIO
2–2
Note to Table 14:
(1) To meet the IOL and IOH specifications, you must set the current strength settings accordingly. For example, to meet the 3.3-V LVTTL specification (4 mA), you
should set the current strength settings to 4 mA. Setting at lower current strength may not meet the IOL and IOH specifications in the handbook.
Table 14. Single-Ended I/O Standards for Arria V Devices (Part 2 of 2)
I/O Standard
VCCIO (V)
VIL (V)
VIH (V)
VOL (V)
VOH (V)
IOL (1)
(mA)
IOH (1)
(mA)
Min
Typ
Max
Min
Max
Min
Max
Min
Table 15. Single-Ended SSTL, HSTL, and HSUL I/O Reference Voltage Specifications for Arria V Devices
I/O Standard
VCCIO(V)
VREF(V)
VTT(V)
Min
Typ
Max
Min
Typ
Max
Min
Typ
Max
SSTL-2
Class I, II
2.375
2.5
2.625
0.49 x VCCIO
0.5 x VCCIO
0.51 x VCCIO
VREF – 0.04
VREF
VREF + 0.04
SSTL-18
Class I, II
1.71
1.8
1.89
0.833
0.9
0.969
VREF – 0.04
VREF
VREF + 0.04
SSTL-15
Class I, II
1.425
1.5
1.575
0.49 x VCCIO
0.5 x VCCIO
0.51 x VCCIO
0.49 x VCCIO
0.5 x VCCIO
0.51 x VCCIO
SSTL-135
Class I, II
1.283
1.35
1.418
0.49 x VCCIO
0.5 x VCCIO
0.51 x VCCIO
0.49 x VCCIO
0.5 x VCCIO
0.51 x VCCIO
SSTL-125
Class I, II
1.19
1.25
1.26
0.49 x VCCIO
0.5 x VCCIO
0.51 x VCCIO
0.49 x VCCIO
0.5 x VCCIO
0.51 x VCCIO
HSTL-18
Class I, II
1.71
1.8
1.89
0.85
0.9
0.95
—
VCCIO/2
—
HSTL-15
Class I, II
1.425
1.5
1.575
0.68
0.75
0.9
—
VCCIO/2
—
HSTL-12
Class I, II
1.14
1.2
1.26
0.47 x VCCIO
0.5 x VCCIO
0.53 x VCCIO
—VCCIO/2
—
HSUL-12
1.14
1.2
1.3
0.49 x VCCIO
0.5 x VCCIO
0.51 x VCCIO
——
—
Table 16. Single-Ended SSTL, HSTL, and HSUL I/O Standards Signal Specifications for Arria V Devices (Part 1 of 2)
I/O Standard
VIL(DC) (V)
VIH(DC) (V)
VIL(AC) (V)
VIH(AC) (V)
VOL (V)
VOH (V)
Iol (1)
(mA)
(mA)
Min
Max
Min
Max
Min
Max
Min
SSTL-2
Class I
–0.3
VREF
–0.15
VREF +
0.15
VCCIO +
0.3
VREF –
0.31
VREF + 0.31
VTT – 0.608
VTT + 0.608
8.1
–8.1
SSTL-2
Class II
–0.3
VREF
–0.15
VREF +
0.15
VCCIO +
0.3
VREF –
0.31
VREF + 0.31
VTT – 0.81
VTT + 0.81
16.2
–16.2
SSTL-18
Class I
–0.3
VREF
–0.125
VREF +
0.125
VCCIO +
0.3
VREF –
0.25
VREF + 0.25
VTT – 0.603
VTT + 0.603
6.7
–6.7
SSTL-18
Class II
–0.3
VREF
–0.125
VREF +
0.125
VCCIO +
0.3
VREF –
0.25
VREF + 0.25
0.28
VCCIO –0.28
13.4
–13.4
SSTL-15
Class I
—
VREF –
0.1
VREF +
0.1
—
VREF –
0.175
VREF +
0.175
0.2 x VCCIO
0.8 x VCCIO
8–8
SSTL-15
Class II
—
VREF –
0.1
VREF +
0.1
—
VREF –
0.175
VREF +
0.175
0.2 x VCCIO
0.8 x VCCIO
16
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