參數(shù)資料
型號(hào)： 5AGXMB3G6F31C6NES
廠商： Altera
文件頁數(shù)： 107/124頁
文件大?。?/td> 0K
描述： IC ARRIA V FPGA 362K 896FBGA
標(biāo)準(zhǔn)包裝： 3
系列： Arria V GX
LAB/CLB數(shù)： 17110
邏輯元件/單元數(shù)： 362730
RAM 位總計(jì)： 2148352
輸入/輸出數(shù)： 384
電源電壓： 1.07 V ~ 1.13 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 85°C
封裝/外殼： 896-BGA
供應(yīng)商設(shè)備封裝： 896-FBGA（31x31）
其它名稱： 544-2735
Electrical Characteristics
Page 11
Arria V GZ Device Datasheet
February 2014
Altera Corporation
2.5 V
2.375
2.5
2.625
–0.3
0.7
1.7
3.6
0.4
2
1
–1
1.8 V
1.71
1.8
1.89
–0.3
0.35
×
VCCIO
0.65
×
VCCIO
VCCIO +
0.3
0.45
VCCIO –
0.45
2–2
1.5 V
1.425
1.5
1.575
–0.3
0.35
×
VCCIO
0.65
×
VCCIO
VCCIO +
0.3
0.25
×
VCCIO
0.75
×
VCCIO
2–2
1.2 V
1.14
1.2
1.26
–0.3
0.35
×
VCCIO
0.65
×
VCCIO
VCCIO +
0.3
0.25
×
VCCIO
0.75
×
VCCIO
2–2
Table 16. Single-Ended I/O Standards for Arria V GZ Devices (Part 2 of 2)
I/O
Standard
VCCIO (V)
VIL (V)
VIH (V)
VOL (V)
VOH (V)
IOL
(mA)
IOH
(mA)
Min
Typ
Max
Min
Max
Min
Max
Min
Table 17. Single-Ended SSTL, HSTL, and HSUL I/O Reference Voltage Specifications for Arria V GZ Devices
I/O Standard
VCCIO (V)
VREF (V)
VTT (V)
Min
Typ
Max
Min
Typ
Max
Min
Typ
Max
SSTL-2
Class I, II
2.375
2.5
2.625
0.49
×
VCCIO
0.5
× VCCIO
0.51
×
VCCIO
VREF –
0.04
VREF
VREF +
0.04
SSTL-18
Class I, II
1.71
1.8
1.89
0.833
0.9
0.969
VREF –
0.04
VREF
VREF +
0.04
SSTL-15
Class I, II
1.425
1.5
1.575
0.49
×
VCCIO
0.5
× VCCIO
0.51
×
VCCIO
0.49
×
VCCIO
0.5
×
VCCIO
0.51
×
VCCIO
SSTL-135
Class I, II
1.283
1.35
1.418
0.49
×
VCCIO
0.5
× VCCIO
0.51
×
VCCIO
0.49
×
VCCIO
0.5
×
VCCIO
0.51
×
VCCIO
SSTL-125
Class I, II
1.19
1.25
1.26
0.49
×
VCCIO
0.5
× VCCIO
0.51
×
VCCIO
0.49
×
VCCIO
0.5
×
VCCIO
0.51
×
VCCIO
SSTL-12
Class I, II
1.14
1.20
1.26
0.49
×
VCCIO
0.5
× VCCIO
0.51
×
VCCIO
0.49
×
VCCIO
0.5
×
VCCIO
0.51
×
VCCIO
HSTL-18
Class I, II
1.71
1.8
1.89
0.85
0.9
0.95
—
VCCIO/2
—
HSTL-15
Class I, II
1.425
1.5
1.575
0.68
0.75
0.9
—
VCCIO/2
—
HSTL-12
Class I, II
1.14
1.2
1.26
0.47
×
VCCIO
0.5
× VCCIO
0.53
×
VCCIO
—VCCIO/2
—
HSUL-12
1.14
1.2
1.3
0.49
×
VCCIO
0.5
× VCCIO
0.51
×
VCCIO
——
—
Table 18. Single-Ended SSTL, HSTL, and HSUL I/O Standards Signal Specifications for Arria V GZ Devices (Part 1 of 2)
I/O Standard
VIL(DC) (V)
VIH(DC) (V)
VIL(AC) (V)
VIH(AC) (V)
VOL (V)
VOH (V)
Iol (mA)
Ioh (mA)
Min
Max
Min
Max
Min
Max
Min
SSTL-2
Class I
–0.3
VREF –
0.15
VREF +
0.15
VCCIO +
0.3
VREF –
0.31
VREF + 0.31
VTT –
0.608
VTT +
0.608
8.1
–8.1
SSTL-2
Class II
–0.3
VREF –
0.15
VREF +
0.15
VCCIO +
0.3
VREF –
0.31
VREF + 0.31
VTT –
0.81
VTT +
0.81
16.2
–16.2
SSTL-18
Class I
–0.3
VREF –
0.125
VREF +
0.125
VCCIO +
0.3
VREF –
0.25
VREF + 0.25
VTT –
0.603
VTT +
0.603
6.7
–6.7
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PDF描述
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5AGXMB5G4F35C5N 功能描述:FPGA - 現(xiàn)場(chǎng)可編程門陣列 FPGA - Arria V GX 15849 LABs 544 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
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