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參數(shù)資料
| 型號(hào)： | XCB56364PV100 |
| 廠商： | MOTOROLA INC |
| 元件分類： | 數(shù)字信號(hào)處理 |
| 英文描述： | 24-Bit Audio Digital Signal Processor |
| 中文描述： | 8-BIT, 100 MHz, OTHER DSP, PQFP112 |
| 封裝： | QFP-112 |
| 文件頁(yè)數(shù)： | 76/162頁(yè) |
| 文件大?。?/td> | 2405K |
| 代理商： | XCB56364PV100 |
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Specifications
Enhanced Serial Audio Interface Timing
2-56
DSP56364 Advance Information
MOTOROLA
2.13
ENHANCED SERIAL AUDIO INTERFACE TIMING
Table 2-20 Enhanced Serial Audio Interface Timing
No.
Characteristics
1, 2, 3
Symbol
Expression
Min
Max
Cond-i
tion
4
Unit
430
Clock cycle
5
t
SSICC
4
×
T
C
40.0
—
i ck
ns
3
×
T
C
30.0
—
x ck
TXC:max[3*tc;
t454]
40.0
—
x ck
431
Clock high period
For internal clock
—
2
×
T
C
10.0
10.0
—
ns
For external clock
1.5
×
T
C
15.0
—
432
Clock low period
For internal clock
—
2
×
T
C
10.0
10.0
—
ns
For external clock
1.5
×
T
C
15.0
—
433
RXC rising edge to FSR out (bl) high
—
—
—
—
37.0
22.0
x ck
i ck a
ns
434
RXC rising edge to FSR out (bl) low
—
—
—
—
37.0
22.0
x ck
i ck a
ns
435
RXC rising edge to FSR out (wr) high
6
—
—
—
—
39.0
24.0
x ck
i ck a
ns
436
RXC rising edge to FSR out (wr) low
6
—
—
—
—
39.0
24.0
x ck
i ck a
ns
437
RXC rising edge to FSR out (wl) high
—
—
—
—
36.0
21.0
x ck
i ck a
ns
438
RXC rising edge to FSR out (wl) low
—
—
—
—
37.0
22.0
x ck
i ck a
ns
439
Data in setup time before RXC (SCK in syn-
chronous mode) falling edge
—
—
0.0
19.0
—
—
x ck
i ck
ns
440
Data in hold time after RXC falling edge
—
—
5.0
3.0
—
—
x ck
i ck
ns
441
FSR input (bl, wr) high before RXC falling
edge
6
—
—
23.0
1.0
—
—
x ck
i ck a
ns
F
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
.
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