Table 26:
參數(shù)資料
型號： XC3S50A-4VQ100I
廠商： Xilinx Inc
文件頁數(shù)： 60/132頁
文件大?。?/td> 0K
描述： IC FPGA SPARTAN 3 100VQFP
標準包裝： 90
系列： Spartan®-3A
LAB/CLB數(shù)： 176
邏輯元件/單元數(shù)： 1584
RAM 位總計： 55296
輸入/輸出數(shù)： 68
門數(shù)： 50000
電源電壓： 1.14 V ~ 1.26 V
安裝類型： 表面貼裝
工作溫度： -40°C ~ 100°C
封裝/外殼： 100-TQFP
供應商設備封裝： 100-VQFP（14x14）
DC and Switching Characteristics
DS529-3 (v2.0) August 19, 2010
33
Output Timing Adjustments
Table 26: Output Timing Adjustments for IOB
Convert Output Time from
LVCMOS25 with 12mA Drive and
Fast Slew Rate to the Following
Signal Standard (IOSTANDARD)
Add the
Adjustment
Below
Units
Speed Grade
-5
-4
Single-Ended Standards
LVTTL
Slow
2 mA
5.58
ns
4 mA
3.16
ns
6 mA
3.17
ns
8 mA
2.09
ns
12 mA
1.62
ns
16 mA
1.24
ns
24 mA
2.74(3)
ns
Fast
2 mA
3.03
ns
4 mA
1.71
ns
6 mA
1.71
ns
8 mA
0.53
ns
12 mA
0.53
ns
16 mA
0.59
ns
24 mA
0.60
ns
QuietIO
2 mA
27.67
ns
4 mA
27.67
ns
6 mA
27.67
ns
8 mA
16.71
ns
12 mA
16.67
ns
16 mA
16.22
ns
24 mA
12.11
ns
LVCMOS33
Slow
2 mA
5.58
ns
4 mA
3.17
ns
6 mA
3.17
ns
8 mA
2.09
ns
12 mA
1.24
ns
16 mA
1.15
ns
24 mA
2.55(3)
ns
Fast
2 mA
3.02
ns
4 mA
1.71
ns
6 mA
1.72
ns
8 mA
0.53
ns
12 mA
0.59
ns
16 mA
0.59
ns
24 mA
0.51
ns
QuietIO
2 mA
27.67
ns
4 mA
27.67
ns
6 mA
27.67
ns
8 mA
16.71
ns
12 mA
16.29
ns
16 mA
16.18
ns
24 mA
12.11
ns
Table 26: Output Timing Adjustments for IOB(Continued)
Convert Output Time from
LVCMOS25 with 12mA Drive and
Fast Slew Rate to the Following
Signal Standard (IOSTANDARD)
Add the
Adjustment
Below
Units
Speed Grade
-5
-4
相關PDF資料
PDF描述
HMC40DRAH CONN EDGECARD 80POS R/A .100 SLD
RSC60DRYN-S734 CONN EDGECARD 120PS DIP .100 SLD
RMC60DRYN-S734 CONN EDGECARD 120PS DIP .100 SLD
RSC60DRYH-S734 CONN EDGECARD 120PS DIP .100 SLD
RMC60DRYH-S734 CONN EDGECARD 120PS DIP .100 SLD
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