參數(shù)資料
型號(hào)： XC3S50A-4VQ100I
廠商： Xilinx Inc
文件頁(yè)數(shù)： 110/132頁(yè)
文件大?。?/td> 0K
描述： IC FPGA SPARTAN 3 100VQFP
標(biāo)準(zhǔn)包裝： 90
系列： Spartan®-3A
LAB/CLB數(shù)： 176
邏輯元件/單元數(shù)： 1584
RAM 位總計(jì)： 55296
輸入/輸出數(shù)： 68
門(mén)數(shù)： 50000
電源電壓： 1.14 V ~ 1.26 V
安裝類型： 表面貼裝
工作溫度： -40°C ~ 100°C
封裝/外殼： 100-TQFP
供應(yīng)商設(shè)備封裝： 100-VQFP（14x14）
第1頁(yè)第2頁(yè)第3頁(yè)第4頁(yè)第5頁(yè)第6頁(yè)第7頁(yè)第8頁(yè)第9頁(yè)第10頁(yè)第11頁(yè)第12頁(yè)第13頁(yè)第14頁(yè)第15頁(yè)第16頁(yè)第17頁(yè)第18頁(yè)第19頁(yè)第20頁(yè)第21頁(yè)第22頁(yè)第23頁(yè)第24頁(yè)第25頁(yè)第26頁(yè)第27頁(yè)第28頁(yè)第29頁(yè)第30頁(yè)第31頁(yè)第32頁(yè)第33頁(yè)第34頁(yè)第35頁(yè)第36頁(yè)第37頁(yè)第38頁(yè)第39頁(yè)第40頁(yè)第41頁(yè)第42頁(yè)第43頁(yè)第44頁(yè)第45頁(yè)第46頁(yè)第47頁(yè)第48頁(yè)第49頁(yè)第50頁(yè)第51頁(yè)第52頁(yè)第53頁(yè)第54頁(yè)第55頁(yè)第56頁(yè)第57頁(yè)第58頁(yè)第59頁(yè)第60頁(yè)第61頁(yè)第62頁(yè)第63頁(yè)第64頁(yè)第65頁(yè)第66頁(yè)第67頁(yè)第68頁(yè)第69頁(yè)第70頁(yè)第71頁(yè)第72頁(yè)第73頁(yè)第74頁(yè)第75頁(yè)第76頁(yè)第77頁(yè)第78頁(yè)第79頁(yè)第80頁(yè)第81頁(yè)第82頁(yè)第83頁(yè)第84頁(yè)第85頁(yè)第86頁(yè)第87頁(yè)第88頁(yè)第89頁(yè)第90頁(yè)第91頁(yè)第92頁(yè)第93頁(yè)第94頁(yè)第95頁(yè)第96頁(yè)第97頁(yè)第98頁(yè)第99頁(yè)第100頁(yè)第101頁(yè)第102頁(yè)第103頁(yè)第104頁(yè)第105頁(yè)第106頁(yè)第107頁(yè)第108頁(yè)第109頁(yè)當(dāng)前第110頁(yè)第111頁(yè)第112頁(yè)第113頁(yè)第114頁(yè)第115頁(yè)第116頁(yè)第117頁(yè)第118頁(yè)第119頁(yè)第120頁(yè)第121頁(yè)第122頁(yè)第123頁(yè)第124頁(yè)第125頁(yè)第126頁(yè)第127頁(yè)第128頁(yè)第129頁(yè)第130頁(yè)第131頁(yè)第132頁(yè)
Pinout Descriptions
DS529-4 (v2.0) August 19, 2010
79
FT256: 256-ball Fine-pitch, Thin Ball Grid Array
The 256-ball fine-pitch, thin ball grid array package, FT256,
supports all five Spartan-3A FPGAs. The XC3S200A and
XC3S400A have identical footprints, and the XC3S700A
and XC3S1400A have identical footprints. The XC3S50A is
compatible with the XC3S200A/XC3S400A but has 51
unconnected balls. The XC3S200A/XC3S400A is similar to
the XC3S700A/XC3S1400A, but the XC3S700A/
XC3S1400A adds more power and ground pins and
therefore is not compatible.
Table 68 lists all the package pins for the XC3S50A,
XC3S200A, and XC3S400A. They are sorted by bank
number and then by pin name of the largest device. Pins
that form a differential I/O pair appear together in the table.
The table also shows the pin number for each pin and the
pin type, as defined earlier.
The highlighted rows indicate pinout differences between
the XC3S50A, the XC3S200A, and the XC3S400A FPGAs.
The XC3S50A has 51 unconnected balls, indicated as N.C.
(No Connection) in Table 68 and Figure 20 and with the
black diamond character (
provides the common footprint for the XC3S200A and
XC3S400A.
Table 68 also indicates that some differential I/O pairs have
different assignments between the XC3S50A and the
XC3S200A/XC3S400A, highlighted in light blue. See
information.
All other balls have nearly identical functionality on all three
devices. Table 73 summarizes the XC3S50A FPGA footprint
migration differences for the FT256 package.
The XC3S50A does not support the address output pins for
the Byte-wide Peripheral Interface (BPI) configuration mode.
Table 69 lists all the package pins for the XC3S700A and
XC3S1400A. They are sorted by bank number and then by
pin name. Pins that form a differential I/O pair appear
together in the table. The table also shows the pin number
for each pin and the pin type, as defined earlier. Figure 22
provides the common footprint for the XC3S200A and
XC3S400A.
An electronic version of this package pinout table and
footprint diagram is available for download from the Xilinx
website at
Pinout Table
Table 68: Spartan-3A FT256 Pinout (XC3S50A,
XC3S200A, XC3S400)
Bank
XC3S50A
XC3S200A
XC3S400A
FT256
Ball
Type
0
IO_L01N_0
C13
I/O
0
IO_L01P_0
D13
I/O
0
IO_L02N_0
B14
I/O
0
IO_L02P_0/
VREF_0
IO_L02P_0/
VREF_0
B15
VREF
0
IO_L03N_0
D11
I/O
0
IO_L03P_0
C12
I/O
0
IO_L04N_0
A13
I/O
0
IO_L04P_0
A14
I/O
0
N.C. (
◆)
IO_L05N_0
A12
I/O
0
IP_0
IO_L05P_0
B12
I/O
0
N.C. (
◆)
IO_L06N_0/
VREF_0
E10
VREF
0
N.C. (
◆)
IO_L06P_0
D10
I/O
0
IO_L07N_0
A11
I/O
0
IO_L07P_0
C11
I/O
0
IO_L08N_0
A10
I/O
0
IO_L08P_0
B10
I/O
0
IO_L09N_0/
GCLK5
IO_L09N_0/
GCLK5
D9
GCLK
0
IO_L09P_0/
GCLK4
IO_L09P_0/
GCLK4
C10
GCLK
0
IO_L10N_0/
GCLK7
IO_L10N_0/
GCLK7
A9
GCLK
0
IO_L10P_0/
GCLK6
IO_L10P_0/
GCLK6
C9
GCLK
0
IO_L11N_0/
GCLK9
IO_L11N_0/
GCLK9
D8
GCLK
0
IO_L11P_0/
GCLK8
IO_L11P_0/
GCLK8
C8
GCLK
0
IO_L12N_0/
GCLK11
IO_L12N_0/
GCLK11
B8
GCLK
0
IO_L12P_0/
GCLK10
IO_L12P_0/
GCLK10
A8
GCLK
0
N.C. (
◆)
IO_L13N_0
C7
I/O
0
N.C. (
◆)
IO_L13P_0
A7
I/O
0
N.C. (
◆)
IO_L14N_0/
VREF_0
E7
VREF
0
N.C. (
◆)
IO_L14P_0
F8
I/O
0
IO_L15N_0
B6
I/O
0
IO_L15P_0
A6
I/O
0
IO_L16N_0
C6
I/O
0
IO_L16P_0
D7
I/O
0
IO_L17N_0
C5
I/O
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PDF描述
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