參數(shù)資料
型號： TMS320VC203
廠商： Texas Instruments, Inc.
元件分類： 數(shù)字信號處理
英文描述： Digital Signal Processors(50ns指令周期， 空閑狀態(tài)CPU全關斷，先進的外圍，多種PLL可選)
中文描述： 數(shù)字信號處理器（50ns的指令周期，空閑狀態(tài)CPU的全關斷，先進的外圍，多種鎖相環(huán)可選）
文件頁數(shù)： 53/67頁
文件大?。?/td> 1452K
代理商： TMS320VC203
TMS320C203, TMS320C209, TMS320VC203
DIGITAL SIGNAL PROCESSOR
SPRS025 – JUNE 1995
53
POST OFFICE BOX 1443
HOUSTON, TEXAS 77251–1443
memory and parallel I/O interface read timing (continued)
A15–A0, PS, DS, IS, RW, and BR timings are all included in the timings referenced to A15–A0 except when
in transition between read and write operations where PS, DS, and IS pulse high [see t
w(NSN)
].
switching characteristics over recommended operating conditions @ 3 V [H = 0.5t
c(CO)
]
PARAMETER
MIN
MAX
MIN
MAX
UNIT
tsu(A)RD
th(A)RD
td(A)CO
th(A)CO
td(CO-RD)
td(CO-S)
tw(RDL)
tw(RDH)
td(RDW)
Values derived from characterization data and not tested.
Setup time, address valid before RD low
H – 7
H – 5
ns
Hold time, address valid after RD high
– 6
– 6
ns
Delay time, address valid after CLKOUT1 low
8
8
ns
Hold time, address valid after CLKOUT1 low
– 2
– 2
ns
Delay time, CLKOUT1 high/low to RD low/high
Delay time, CLKOUT1 low to STRB low/high
– 1
5
– 1
5
ns
1
5
1
5
ns
Pulse duration, RD low (no wait states)
H – 3
H + 2
H – 3
H + 2
ns
Pulse duration, RD high
H – 4
H + 2
H – 4
H + 2
ns
Delay time, RD high to WE low
2H – 8
2H – 8
timing requirements over recommended operating conditions @ 3 V [H = 0.5t
c(CO)
]
MIN
MAX
MIN
MAX
UNIT
ta(A)
tsu(D)RD
th(D)RD
th(D)A
tsu(DCOL)R
th(DCOL)R
ta(RD)
Values derived from characterization data and not tested.
Access time, read data from address time
2H – 14
2H – 14
ns
Setup time, data read before RD high
13
13
ns
Hold time, data read from RD high
– 2
– 2
ns
Hold time, read data from address invalid
0
0
ms
Setup time, data read before CLKOUT1 low
9
9
ns
Hold time, data read from CLKOUT1 low
– 1
– 1
ns
Access time, read data after RD low
H – 12
H – 12
ns
A
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PDF描述
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TN-103 MICROWAVE NOISE TUBES & NOISE SOURCES
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