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參數(shù)資料
| 型號： | TMP89FH42UG |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, FLASH, 10 MHz, MICROCONTROLLER, PQFP44 |
| 封裝： | 10 X 10 MM, 0.80 MM PITCH, LEAD FREE, PLASTIC, LQFP-44 |
| 文件頁數(shù)： | 247/317頁 |
| 文件大?。?/td> | 6434K |
| 代理商： | TMP89FH42UG |
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Clock input from an external oscillator is also possible. In this case, external clocks are applied to the XIN/
XTIN pins and the XOUT/XTOUT pins are kept open.
Enabling/disabling the oscillation of the high-frequency clock oscillation circuit and the low-frequency
clock oscillation circuit and switching the pin function to ports are controlled by the software and hardware.
The software control is executed by SYSCR2<XEN>, SYSCR2<XTEN> and the P0 port function control
register P0FC.
The hardware control is executed by reset release and the operation mode control circuit when the operation
is switched to the STOP mode as described in "2.3.5 Operation mode control circuit".
Note:No hardware function is available for external direct monitoring of the basic clock. The oscillation fre-
quency can be adjusted by programming the system to output pulses at a certain frequency to a port
(for example, a clock output) with interrupts disabled and the watchdog timer disabled and monitoring
the output. An adjustment program must be created in advance for a system that requires adjustment
of the oscillation frequency.
To prevent the dead lock of the CPU core due to the software-controlled enabling/disabling of the oscil-
lation, an internal factor reset is generated depending on the combination of values of the clock selected as
the main system clock, SYSCR2<XEN>, SYSCR2<XTEN> and the P0 port function control register P0FC0.
Table 2-1 Prohibited Combinations of Oscillation Enable Register Conditions
P0FC0
SYSCR2
<XEN>
SYSCR2
<XTEN>
SYSCR2
<SYSCK>
State
Don't Care
0
Don’t Care All the oscillation circuits are stopped.
Don’t Care
0
1
The low-frequency clock (fs) is selected as the main system
clock, but the low-frequency clock oscillation circuit is stop-
ped.
Don’t Care
0
Don’t Care
0
The high-frequency clock (fc) is selected as the main system
clock, but the high-frequency clock oscillation circuit is stop-
ped.
0
1
Don’t Care
The high-frequency clock oscillation circuit is allowed to os-
cillate, but the port is set as a general-purpose port.
Note:It takes a certain period of time after SYSCR2<SYSCK> is changed before the main system clock is
switched. If the currently operating oscillation circuit is stopped before the main system clock is switch-
ed, the internal condition becomes as shown in Table 2-1 and a system clock reset occurs. For details
of clock switching, refer to "2.3.6 Operation Mode Control".
XIN
High-frequency clock
XOUT
(a) Crystal or ceramic
oscillator
XIN
XOUT
(b) External oscillator
(Open)
XTIN
Low-frequency clock
XTOUT
(c) Crystal oscillator
XTIN
XTOUT
(d) External oscillator
(Open)
Figure 2-4 Examples of Oscillator Connection
2.3.3.2
Clock gear
The clock gear is a circuit that selects a gear clock (fcgck) obtained by dividing the high-frequency clock
(fc) and inputs it to the timing generator.
Selects a divided clock at CGCR<FCGCKSEL>.
TMP89FH42
Page 19
RA004
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| TMP91FW60FG | MICROCONTROLLER, PQFP100 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| TMP89FH46LDUG | 制造商:TOSHIBA 制造商全稱:Toshiba Semiconductor 功能描述:Microcomputers / Microcomputer Development Systems |
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