參數(shù)資料
型號(hào)： SM34020AHTM32
廠商： TEXAS INSTRUMENTS INC
元件分類： 圖形處理器
英文描述： GRAPHICS PROCESSOR, CQFP132
封裝： CERAMIC, QFP-132
文件頁(yè)數(shù)： 90/98頁(yè)
文件大?。?/td> 1546K
代理商： SM34020AHTM32
SMJ34020A
GRAPHICS SYSTEM PROCESSOR
SGUS011D -- APRIL 1991 -- REVISED SEPTEMBER 2004
90
POST OFFICE BOX 1443
HOUSTON, TEXAS 77251--1443
video-shift-clock timing: SCLK (see Figure 53)
NO
’34020A-32
’34020A-40
UNIT
NO.
MIN
MAX
MIN
MAX
UNIT
117
tc(SCK)
Cycle time, period of video serial clock SCLK
35
50
25
50
ns
118
tw(SCKH)
Pulse duration, SCLK high
12
10
ns
119
tw(SCKL)
Pulse duration, SCLK low
12
10
ns
120
tt(SCK)
Transition time, (rise and fall) of SCLK
2 *
5 *
2 *
5 *
ns
* This parameter is not production tested.
SCLK
120
117
119
118
Figure 53. Video-Shift-Clock Timing: SCLK
video-interface timing: VCLK and video outputs (see Figure 54)
NO
’34020A-32
’34020A-40
UNIT
NO.
MIN
MAX
MIN
MAX
UNIT
123
tc(VCK)
Cycle time, period of video input clock VCLK
62.5
100
62.5
100
ns
124
tw(VCKH)
Pulse duration, VCLK high
28
ns
125
tw(VCKL)
Pulse duration, VCLK low
28
ns
126
tt(VCK)
Transition time, (rise and fall) of VCLK
2*
5 *
2 *
5*
ns
127
td(VCKL-HSL)
Delay time, VCLK low to HSYNC, VSYNC, CSYNC/VBLNK or
CBLNK/VBLNK low
40
ns
128
td(VCKL-HSH)
Delay time, VCLK low to HSYNC, VSYNC, CSYNC/HBLNK,or
CBLNK/VBLNK high
40
ns
129
th(VCKL-HSL)
Hold time, VCLK no longer high to HSYNC, VSYNC,
CSYNC/HBLNK,orCBLNK/VBLNK no longer high
0*
0 *
ns
130
th(VCKL-HSH)
Hold time, VCLK no longer high to HSYNC, VSYNC,
CSYNC/HBLNK,orCBLNK/VBLNK no longer low
0 *
ns
* This parameter is not production tested.
VCLK
HSYNC
VSYNC
CSYNC/HBLNK
CBLNK/VBLNK
(outputs)
130
127
129
128
126
123
125
124
Figure 54. Video-Interface Timing: VCLK and Video Outputs
相關(guān)PDF資料
PDF描述
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