Figures
6
December 2004
SGUS053
List of Figures
Figure
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21. SM320F2812 172-Pin HFG CQFP (Top View)
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31. Functional Block Diagram
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32. F2812 Memory Map
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33. External Interface Block Diagram
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34. Interrupt Sources
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35. Multiplexing of Interrupts Using the PIE Block
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36. Clock and Reset Domains
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37. OSC and PLL Block
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38. Recommended Crystal / Clock Connection
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39. Watchdog Module
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41. CPU-Timers
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42. CPU-Timer Interrupts Signals and Output Signal
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43. Event Manager A Functional Block Diagram
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44. Block Diagram of the F2812 ADC Module
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45. ADC Pin Connections With Internal Reference
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46. ADC Pin Connections With External Reference
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47. eCAN Block Diagram and Interface Circuit
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48. eCAN Memory Map
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49. McBSP Module With FIFO
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410. Serial Communications Interface (SCI) Module Block Diagram
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411. Serial Peripheral Interface Module Block Diagram (Slave Mode)
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412. GPIO/Peripheral Pin Multiplexing
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51. 28x Device Nomenclature
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61. Typical Current Consumption Over Frequency
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62. Typical Power Consumption Over Frequency
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63. F2812 Typical Power-Up and Power-Down Sequence Option 2
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64. Output Levels
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65. Input Levels
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66. 3.3-V Test Load Circuit
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67. Clock Timing
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68. Power-on Reset in Microcomputer Mode (XMP/MC = 0)
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69. Power-on Reset in Microprocessor Mode (XMP/MC = 1)
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610. Warm Reset in Microcomputer Mode
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611. Effect of Writing Into PLLCR Register
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612. IDLE Entry and Exit Timing
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613. STANDBY Entry and Exit Timing
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614. HALT Wakeup Using XNMI
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615. PWM Output Timing
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616. TDIRx Timing
102
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617. EVASOC Timing
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