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參數(shù)資料
| 型號： | RJ80530MY650256 |
| 元件分類： | 微處理器 |
| 英文描述： | MICROPROCESSOR|32-BIT|CMOS|BGA|479PIN|CERAMIC |
| 中文描述： | 微處理器| 32位|的CMOS | BGA封裝| 479PIN |陶瓷 |
| 文件頁數(shù)： | 51/89頁 |
| 文件大?。?/td> | 1672K |
| 代理商： | RJ80530MY650256 |
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Mobile Intel
Pentium
III Processor-M Datasheet
298340-002
Datasheet
51
Table 32. PICCLK DC Specifications and AC Signal Quality Specifications
Symbol
Parameter
Min Max Unit
Figure
Notes
V1
V
IL20
0.4
V
20
Note 1
V2
V
IH20
1.6
V
20
Note 1
V3
V
IN
Absolute Voltage Range
-0.5 2.4
V
20
Undershoot, Overshoot, Note 2
V4
PICCLK Rising Edge Ringback
1.6
V
20
Absolute Value, Note 3
V5
NOTES:
1.
The clock must rise/fall monotonically between V
IL20
and V
IH20
.
2.
These specifications apply only when PICCLK is running. See the DC specifications for when PICCLK is
stopped. PICCLK may not be above V
IH20,max
or below V
IL20,min
for more than 50% of the clock cycle.
3.
The rising and falling edge ringback voltage specified is the minimum (rising) or maximum (falling) absolute
voltage the PICCLK signal can go to after passing the V
IH20
(rising) or V
IL20
(falling) voltage limits.
PICCLK Falling Edge Ringback
0.4
V
20
Absolute Value, Note 3
Figure 20. BCLK (Single Ended)/PICCLK Generic Clock Waveform
V0012-01
V1
V2
V3
max
V4
V3
min
V5
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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參數(shù)描述 |
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