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參數(shù)資料
| 型號： | RJ80530MY650256 |
| 元件分類： | 微處理器 |
| 英文描述： | MICROPROCESSOR|32-BIT|CMOS|BGA|479PIN|CERAMIC |
| 中文描述： | 微處理器| 32位|的CMOS | BGA封裝| 479PIN |陶瓷 |
| 文件頁數(shù)： | 48/89頁 |
| 文件大?。?/td> | 1672K |
| 代理商： | RJ80530MY650256 |
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Mobile Intel
Pentium
III Processor-M Datasheet
48
Datasheet
298340-002
Figure 17.Quick Start/Deep Sleep Timing (BCLK Stopping Method)
T
w
stpgnt
Stopped
BCLK
STPCLK#
CPU bus
DPSLP#
Compatibility
Signals
Changing
Normal
Quick Start
Deep Sleep
Quick Start
Normal
Frozen
T
v
T
y
T
z
T
x
V00102-00
NOTES
:
T
v
=T45 (Stop Grant Acknowledge Bus Cycle Completion to Clock Shut Off Delay)
T
w
=T46 (Setup Time to Input Signal Hold Requirement)
T
x
=T47 (Deep Sleep PLL Lock Latency)
T
y
=T48 (PLL lock to STPCLK# Hold Time)
T
z
=T49 (Input Signal Hold Time)
Figure 18. Quick Start/Deep Sleep Timing (DPSLP# Assertion Method)
T
w
stpgnt
BCLK
STPCLK#
CPU bus
DPSLP#
Compatibility
Signals
Changing
Normal
Quick Start
Deep Sleep
Quick Start
Normal
Frozen
T
v
T
y
T
z
T
x
V00103-00
NOTES
:
T
v
=T45 (Stop Grant Acknowledge Bus Cycle Completion to DPSLP# assertion)
T
w
=T46 (Setup Time to Input Signal Hold Requirement)
T
x
=T47 (Deep Sleep PLL Lock Latency)
T
y
=T48 (PLL lock to STPCLK# Hold Time)
T
z
=T49 (Input Signal Hold Time)
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