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參數(shù)資料
| 型號(hào)： | ML671000 |
| 廠商： | LAPIS SEMICONDUCTOR CO LTD |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, 24 MHz, RISC MICROCONTROLLER, PQFP128 |
| 封裝： | 14 X 20 MM, 0.50 MM PITCH, PLASTIC, QFP-128 |
| 文件頁數(shù)： | 11/303頁 |
| 文件大?。?/td> | 1395K |
| 代理商： | ML671000 |
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ML671000 User’s Manual
Chapter 7
Timers
7-17
7.3.1.3. Pulse Width Modulation (PWM) Mode
Writing 10b (PWM) to the MOD field in a timer control register (TMnCON, n=0 to 1) configures
the corresponding flexible timer as a pulse width modulation timer with the period in the timer
register (TMnR, n=0 to 1) and the length of the first half of the PWM output in the timer general-
purpose register (TMnGR, n=0 to 1).
The result of comparing
the timer counter (TMnC, n=0 to 1) contents with those in the timer
general-purpose register (TMnGR, n=0 to 1)
updates the TMOUT bit in the corresponding timer
output register (TMnOUT, n=0 to 1) and thus the timer output pin (TMOUT[n], n=0 to 1) output
level using the strategy specified by the IOLV field in the corresponding timer I/O level register
(TMnIOV, n=0 to 1).
0 0:
The TMOUT bit goes to “0” if timer counter is equal to or less than timer general-purpose
register and to “0” otherwise.
0 1:
The TMOUT bit goes to “1” if timer counter is equal to or less than timer general-purpose
register and to “0” otherwise.
Timer counter (TMnC, n=0 to 1) overflow then triggers a timer overflow interrupt request (TMOVn,
n=0 to 1).
Figure 7-15 illustrates PWM operation.
n = 0 or 1
0xFFFF
0x0000
FTMOVn
TMnGR value
TMOUT[n] output for
IOLV of 00b
TMOUT[n] output for
IOLV of 01b
Initial timer
counter value
from TMnC
Timer counter (TMnC) value
Figure 7-15
PWM Mode Operation
相關(guān)PDF資料 |
PDF描述 |
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