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參數(shù)資料
| 型號(hào)： | ADUC7021BCPZ62-RL7 |
| 廠商： | Analog Devices Inc |
| 文件頁(yè)數(shù)： | 2/92頁(yè) |
| 文件大?。?/td> | 0K |
| 描述： | IC MCU 12BIT 1MSPS UART 40-LFCSP |
| 標(biāo)準(zhǔn)包裝： | 750 |
| 系列： | MicroConverter® ADuC7xxx |
| 核心處理器： | ARM7 |
| 芯體尺寸： | 16/32-位 |
| 速度： | 44MHz |
| 連通性： | EBI/EMI，I²C，SPI，UART/USART |
| 外圍設(shè)備： | PLA，PWM，PSM，溫度傳感器，WDT |
| 輸入/輸出數(shù)： | 13 |
| 程序存儲(chǔ)器容量： | 64KB（32K x 16） |
| 程序存儲(chǔ)器類型： | 閃存 |
| RAM 容量： | 2K x 32 |
| 電壓 - 電源 (Vcc/Vdd)： | 2.7 V ~ 3.6 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 8x12b，D/A 2x12b |
| 振蕩器型： | 內(nèi)部 |
| 工作溫度： | -40°C ~ 125°C |
| 封裝/外殼： | 40-VFQFN 裸露焊盤，CSP |
| 包裝： | 帶卷 (TR) |
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ADuC7019/20/21/22/24/25/26/27/28
Rev. B | Page 10 of 92
Table 3. External Memory Read Cycle
Parameter
Min
Typ
Max
Unit
CLK
1/MD Clock
ns typ × (CDPOWCON[2:0] + 1)
tMS_AFTER_CLKH
4
8
ns
tADDR_AFTER_CLKH
4
16
ns
tAE_H_AFTER_MS
CLK
tAE
(XMxPAR[14:12] + 1) × CLK
tHOLD_ADDR_AFTER_AE_L
CLK + (! XMxPAR[10] ) × CLK
tRD_L_AFTER_AE_L
CLK + (! XMxPAR[10]+ ! XMxPAR[9] ) × CLK
tRD_H_AFTER_CLKH
0
4
tRD
(XMxPAR[3:0] + 1) × CLK
tDATA_BEFORE_RD_H
16
ns
tDATA_AFTER_RD_H
8
+ (! XMxPAR[9]) × CLK
tRELEASE_MS_AFTER_RD_H
1 × CLK
04
95
5-
0
53
ECLK
GP0
AE
WS
RS
A/D[15:0]
BHE
BLE
XA16
FFFF
2348
XXXX CDEF XX
234A
XX
89AB
CLK
tAE_H_AFTER_MS
tAE
tHOLD_ADDR_AFTER_AE_L
tRD_L_AFTER_AE_L
tRD
tRD_H_AFTER_CLKH
tADDR_AFTER_CLKH
tRELEASE_WS_AFTER_RD_H
tDATA_BEFORE_RD_H
tDATA_AFTER_RD_H
SAMPLE_DATA_H
SAMPLE_DATA_L
SAMPLE_ADDR_0
SAMPLE_ADDR_1
tMS_AFTER_CLKH
Figure 4. External Memory Read Cycle
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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