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參數(shù)資料
| 型號： | XRT79L71IB-F |
| 廠商： | Exar Corporation |
| 文件頁數(shù)： | 257/609頁 |
| 文件大小： | 0K |
| 描述： | IC LIU/FRAMER DS3/E3 1CH 208BGA |
| 標(biāo)準(zhǔn)包裝： | 126 |
| 控制器類型： | DS3/E3 調(diào)幀器 |
| 接口： | LIU |
| 電源電壓： | 3.15 V ~ 3.45 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 208-LBGA |
| 供應(yīng)商設(shè)備封裝： | 208-STBGA（17x17） |
| 包裝： | 托盤 |
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PRELIMINARY
XRT79L71
18
REV. P2.0.0
1-CHANNEL DS3/E3 CLEAR-CHANNEL FRAMERLIU COMBO - CC/HDLC ARCHITECTURE
To extract out the payload data from incoming PLCP frame (which consists of ATM cells) and to route this
data to the Receive ATM Cell Processor block for further processing
Can be by-passed for Direct-Mapped ATM Applications
1.3.13
The Receive LAPD Controller Block
The purpose of the Receive LAPD Controller block is to permit the user to receive LAPD/PMDL (Path
Maintenance Data Link) Messages from the remote terminal equipment. The Receive LAPD Controller block
comes with a Receive LAPD Controller (not to be confused with the Receive High-Speed HDLC Controller
block) and 90 bytes of on-chip RAM (for storage of inbound PMDL Messages) after reception.
1.3.14
The Receive SSM Controller Block (E3, ITU-T G.832 Applications Only)
The purpose of the Receive SSM Controller block is to permit a given terminal equipment to receive (and
extract out) the SSM (Synchronization Status Message) from the remote terminal equipment, via the MA byte,
within each inbound E3, ITU-T G.832 data-stream.
The Receive SSM Controller block will also alert the
Microprocessor (by generating an interrupt) anytime it detects a change in the incoming SSM value.
1.3.15
The Receive Trail-Trace Message Controller Block (E3, ITU-T G.832 Applications Only)
The purpose of the Receive Trail-Trace Message Controller Block is to permit a given terminal equipment to
receive (and extract out) the Trail-Trace Message (also known as "Trail-Access Pointer Identifier) from the
remote terminal equipment, via the TR byte, within each inbound E3, ITU-T G.832 frame. The Receive Trail-
Trace Message Controller block will also alert the Microprocessor (by generating an interrupt) anytime it
detects a change in the incoming Trail-Trace Message.
1.3.16
The Receive FEAC Controller Block (DS3, C-bit Parity Applications Only)
The purpose of the Receive FEAC Controller block is to permit the user to receive FEAC (Far-End Alarm &
Control) Messages from the remote terminal equipment.
NOTE: The Receive FEAC Controller block is only active if the XRT79L71 is configured to operate in the DS3, C-bit Parity
Framing format.
1.3.17
The Receive ATM Cell Processor Block
The purpose of the Receive ATM Cell Processor block is to extract out the data (being carried by the incoming
DS3/E3 frame or PLCP frame data-stream) and to perform the following operations on it.
Cell Delineation
HEC Byte Verification
User and Idle Cell Filtering
To receive cells with user-specified header bytes and to load them into the Receive Cell Extraction Memory
Buffer (where they can be read out and accessed via the Microprocessor Interface)
To read out a user-specified ATM cell (which is residing in the Receive Cell Insertion Buffer) and to insert this
cell into the Receive ATM Cell traffic
To route all filtered cells to the RxFIFO (where it will be made available to the ATM Layer Processor via the
Receive UTOPIA Interface block)
1.3.18
The Receive Overhead Data Output Interface block
The purpose of the Receive Overhead Data Output Interface block is to permit the user to extract out the
overhead bits (within the incoming DS3/E3 data-stream) and to route this data to some off-chip System-Side
Terminal Equipment circuitry.
1.3.19
The Receive UTOPIA Interface block
The purpose of the Receive UTOPIA Interface block is to provide a standard UTOPIA Level 1, 2 or 3 interface
to the ATM Layer Processor, for reading out the contents of all ATM cells that are written into the RxFIFO.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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參數(shù)描述 |
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