參數(shù)資料
型號(hào)： XRT79L71IB-F
廠商： Exar Corporation
文件頁數(shù)： 147/609頁
文件大小： 0K
描述： IC LIU/FRAMER DS3/E3 1CH 208BGA
標(biāo)準(zhǔn)包裝： 126
控制器類型： DS3/E3 調(diào)幀器
接口： LIU
電源電壓： 3.15 V ~ 3.45 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 208-LBGA
供應(yīng)商設(shè)備封裝： 208-STBGA（17x17）
包裝： 托盤
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XRT79L71
PRELIMINARY
215
1-CHANNEL DS3/E3 CLEAR-CHANNEL FRAMERLIU COMBO - CC/HDLC ARCHITECTURE
REV. P2.0.0
decremented, or kept at zero if a non-Idle M-frame is detected. The Receive DS3 Framer block will declare an
Idle Condition if this counter reaches the value of 63 M-frames or greater. Explained another way, the Receive
DS3 Framer block will declare an Idle Condition if the number of Idle-Pattern M-frames is detected such that it
meets the following conditions.
NIDLE - NVALID
63,
where:
NIDLE = the number of M-frames containing Idle Patterns
NVALID = the number of M-frames not exhibit the Idle Pattern
Anytime the contents of this Up/Down Counter reaches the number 63, then the Receive DS3 Framer block
will:
Set Bit 5 (RxIdle of the Receive DS3 Configuration and Status Register, as depicted below.
The Receive DS3 Framer block will also generate a Change in Idle Status interrupt request, by asserting the
Interrupt Output pin (e.g., by pulling it "Low") and setting Bit 4 (Idle Interrupt Status), within the Receive DS3
Interrupt Status Register, to "1" as illustrated below.
4.3.2.5.2
Clearing the Idle Condition
The Receive DS3 Framer block will clear the Idle Condition if it has detected a sufficient number of Non-Idle M-
frames, such that this Up/Down Counter reaches the value "0". The Receive DS3 Framer block will indicate
that it is clearing the Idle Condition by:
Setting Bit 5 of the (RxIdle Condition Declared) within the Receive DS3 Configuration and Status Register to
"0" as depicted below.
Receive DS3 Configuration and Status Register (Address = 0x1110)
BIT 7
BIT 6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
RxAIS
Defect
Declared
RxLOS
Defect
Declared
RxIdle
Condition
Declared
RxOOF
Defect
Declared
Unused
Framing with
Valid P-Bits
F-Sync Algo
M-Sync Algo
R/O
R/W
0
1
0
Receive DS3 Interrupt Status Register (Address =0x1113)
BIT 7
BIT 6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
Detection of
CP Bit Error
Interrupt
Status
Change of
LOS Defect
Condition
Interrupt
Status
Change of
AIS Defect
Condition
Interrupt
Status
Change of
DS3 Idle
Condition
Interrupt
Status
Change of
FERF Defect
Condition
Interrupt
Status
Change of
AIC State
Interrupt
Status
Change of
OOF Defect
Condition
Interrupt
Status
Detection of
P-Bit Error
Interrupt
Status
RUR
0
1
0
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PDF描述
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參數(shù)描述
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XRT79L72IB 制造商:EXAR 制造商全稱:EXAR 功能描述:2 - CHANNEL DS3/E3 ATM UNI/PPP COMBO IC
XRT79L73 制造商:EXAR 制造商全稱:EXAR 功能描述:3 - CHANNEL DS3/E3 ATM UNI/PPP COMBO IC
XRT79L73IB 制造商:EXAR 制造商全稱:EXAR 功能描述:3 - CHANNEL DS3/E3 ATM UNI/PPP COMBO IC
XRT79L74 制造商:EXAR 制造商全稱:EXAR 功能描述:4 - CHANNEL DS3/E3 ATM UNI/PPP COMBO IC
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