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參數(shù)資料
| 型號(hào)： | ST72T85A5Q6 |
| 廠商： | 意法半導(dǎo)體 |
| 英文描述： | 8-BIT MCU FOR RDS WITH 48K ROM, 3K RAM, ADC, TWO TIMERS, TWO SPIs, I2C AND SCI INTERFACES |
| 中文描述： | 8位微控制器48,000鐵路發(fā)展策略光盤(pán)，3K內(nèi)存，ADC，兩個(gè)定時(shí)器，2個(gè)SPI，I2C和脊髓損傷接口 |
| 文件頁(yè)數(shù)： | 90/117頁(yè) |
| 文件大?。?/td> | 748K |
| 代理商： | ST72T85A5Q6 |
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ST7285C
CONTROL TIMING
(Cont’d)
SERIAL PERIPHERAL INTERFACE
Symbol
Ref.
Characteristics
f
OSC
= 8.0MHz
Min.
Unit
Max.
Operating Frequency =f
OSC/2
= f
OP
Master
Slave
Cycle Time
Master
Slave
Enable Lead Time
Master
Slave
Enable Lag time
Master
Slave
Clock (SCK)High Time
Master
Slave
Clock (SCK) Low Time
Master
Slave
Data Set-up Time
Master
Slave
Data Hold Time (Inputs)
Master
Slave
Access Time (Time to Data Active from High Impedance State)
Slave
Disable Time (Hold Time to High Impedance State)
Slave
Data Valid
Master (Before Capture Edge)
Slave (After Enable Edge)
(2)
Data Hold Time (Outputs)
Master (Before Capture Edge)
Slave (After Enable Edge)
Rise Time (20% V
DD
to 70% V
DD
, C
L
= 200pF)
SPI Outputs (SCK, MOSI, MISO)
SPI Inputs (SCK, MOSI, MISO, SS)
Fall Time (70% V
DD
to 20% V
DD
, C
L
SPI Outputs (SCK, MOSI, MISO)
SPI Inputs (SCK, MOSI, MISO, SS)
f
OP
(m)
f
OP
(s)
dc
dc
0.5
4.0
f
OP
MHz
1
t
CYC(m)
t
CYC(s)
2.0
240
t
CYC
ns
ns
2
t
lead(m)
t
lead(s)
(1)
120
3
ns
(1)
120
4
t
W(SCKH)
t
W(SCKH)
100
90
ns
ns
5
t
W(SCKL)
t
W(SCKL)
100
90
ns
ns
6
t
SU(m)
t
SU(s)
100
100
ns
ns
7
t
H(m)
t
H(s)
t
A
100
100
ns
ns
ns
8
0
120
t
DIS
9
ns
240
10
t
V(m)
t
V(s)
0.25
t
CYC(m)
ns
120
11
t
HO(m)
t
HO(s)
0.25
0
t
CYC(m)
ns
12
t
RM
t
RS
100
2.0
ns
μ
s
13
t
FM
t
FS
100
2.0
ns
μ
s
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