參數(shù)資料
型號(hào)： L80225
英文描述： L80225 10/100 MbpsTX/10BT Ethernet Physical Layer Device (PHY) technical manual 4/02
中文描述： L80225 10/100 MbpsTX/10BT以太網(wǎng)物理層器件（PHY）技術(shù)手冊(cè)4月2日
文件頁(yè)數(shù)： 31/192頁(yè)
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代理商： L80225
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Draft 6/5/00
Block Diagram Description
2-11
Copyright 2000 by LSI Logic Corporation. All rights reserved.
Because the OSCIN input clock generates the TX_CLK output clock, the
TXD[3:0], TX_EN, and TX_ER signals are also clocked in on rising
edges of OSCIN.
On the receive side, as long as a valid data packet is not detected, CRS
and RX_DV are deasserted and the RXD[3:0] signals are held LOW.
When the start of packet is detected, CRS and RX_DV are asserted on
the falling edge of RX_CLK. The assertion of RX_DV indicates that valid
data is clocked out on RXD[3:0] on the falling edge of the RX_CLK. The
RXD[3:0] data has the same frame structure as the TXD[3:0] data and
is specified in IEEE 802.3 and shown in
Figure 2.3
. When the end of the
packet is detected, CRS and RX_DV are deasserted, and RXD[3:0] is
held LOW. CRS and RX_DV also stay deasserted if the device is in the
Link Fail State.
RX_ER is a receive error output that is asserted when certain errors are
detected on a data nibble. RX_ER is asserted on the falling edge of
RX_CLK for the duration of that RX_CLK clock cycle during which the
nibble containing the error is output on RXD[3:0].
The collision output, COL, is asserted whenever the collision condition is
detected.
MII (10 Mbits/s) –
MII 10 Mbits/s operation is identical to 100 Mbits/s
operation except:
J
SSD #1
0b11000
0b0101
K
SSD #2
0b10001
0b0101
T
ESD #1
0b01101
0b0000
R
ESD #2
0b00111
0b0000
H
Halt
0b00100
Undefined
–
Invalid codes
All others
1
0b0000*
1. These 5B codes are not used. The decoder decodes these 5B codes to
4B 0000. The encoder encodes 4B 0000 to 5B 11110, as shown in symbol
Data 0.
Table 2.3
4B/5B Symbol Mapping (Cont.)
Symbol
Name
Description
5B Code
4B Code
相關(guān)PDF資料
PDF描述
L80223 10BASE-T/100BASE-TX/FX Ethernet Physical Layer Device (PHY)(10BASE-T/100BASE-TX/FX 以太網(wǎng)物理層處理器)
L80600 L80600 10/100/1000 Mbits/s Ethernet PHY technical manual 3/01
L811-1X1T-03 1port.None LEDs.low profile RJ45 10/100Base-TX
L82-510 Logic IC
L82-511 Logic IC
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
L80225/B 制造商:LSI Corporation 功能描述:TRANSITION TO P/N 68080A1 - Bulk
L80225/C 制造商:LSI Corporation 功能描述:PN may be NE SA DW 制造商:LSI Corporation 功能描述:L80225/C
L80225FR 制造商:LAUREL ELECTRONICS 功能描述:Laureate 1/8 DIN multi-function counter / timer, universal 85-264 Vac power, two
L80225VF2 制造商:LAUREL ELECTRONICS 功能描述:Laureate 1/8 DIN multi-function counter / timer, universal 85-264 Vac power, two
L80227 制造商:未知廠家 制造商全稱:未知廠家 功能描述:10BASE-T/ 100BASE-TX Ethernet PHY
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