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參數(shù)資料
| 型號： | L80225 |
| 英文描述： | L80225 10/100 MbpsTX/10BT Ethernet Physical Layer Device (PHY) technical manual 4/02 |
| 中文描述： | L80225 10/100 MbpsTX/10BT以太網(wǎng)物理層器件（PHY）技術(shù)手冊4月2日 |
| 文件頁數(shù)： | 30/192頁 |
| 文件大?。?/td> | 1306K |
| 代理商： | L80225 |
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Draft 6/5/00
2-10
Functional Description
Copyright 2000 by LSI Logic Corporation. All rights reserved.
of the TX_CLK output clock. TXD[3:0] input data is nibble wide packet
data whose format must be the same as specified in IEEE 802.3 and
shown in
Figure 2.3
. When all data on TXD[3:0] has been latched into
the device, TX_EN must be deasserted on the rising edge of TX_CLK.
TX_ER is also clocked in on the rising edge of TX_CLK. TX_ER is a
transmit error signal. When this signal is asserted, the device substitutes
an error nibble in place of the normal data nibble that was clocked in on
TXD[3:0]. The error nibble is defined to be the /H/ symbol, which is
defined in IEEE 802.3 and shown in
Table 2.3
.
Table 2.3
4B/5B Symbol Mapping
Symbol
Name
Description
5B Code
4B Code
0
Data 0
0b11110
0b0000
1
Data 1
0b01001
0b0001
2
Data 2
0b10100
0b0010
3
Data 3
0b10101
0b0011
4
Data 4
0b01010
0b0100
5
Data 5
0b01011
0b0101
6
Data 6
0b01110
0b0110
7
Data 7
0b01111
0b0111
8
Data 8
0b10010
0b1000
9
Data 9
0b10011
0b1001
A
Data A
0b10110
0b1010
B
Data B
0b10111
0b1011
C
Data C
0b11010
0b1100
D
Data D
0b11011
0b1101
E
Data E
0b11100
0b1110
F
Data F
0b11101
0b1111
I
Idle
0b11111
0b0000
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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參數(shù)描述 |
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