參數(shù)資料
型號： ISP1181BDGG
廠商： NXP SEMICONDUCTORS
元件分類： 總線控制器
英文描述： Full-speed Universal Serial Bus peripheral controller
中文描述： UNIVERSAL SERIAL BUS CONTROLLER, PDSO48
封裝： 6.10 MM, PLASTIC, MO-153, SOT-362-1, TSSOP-48
文件頁數(shù)： 50/70頁
文件大?。?/td> 341K
代理商： ISP1181BDGG
Philips Semiconductors
ISP1181B
Full-speed USB peripheral controller
Product data
Rev. 02 — 07 December 2004
50 of 70
9397 750 13958
Koninklijke Philips Electronics N.V. 2004. All rights reserved.
T
PERIOD
is the bit duration corresponding with the USB data rate.
Full-speed timing symbols have a subscript prefix ‘F’, low-speed timings a prefix ‘L.
Fig 15. Source differential data-to-EOP transition skew and EOP width.
mgr776
T
PERIOD
differential
data lines
crossover point
differential data to
SE0/EOP skew
N
×
T
PERIOD
+
t
DEOP
source EOP width: t
EOPT
receiver EOP width: t
EOPR
crossover point
extended
+
3.3 V
0 V
T
PERIOD
is the bit duration corresponding with the USB data rate.
Fig 16. Receiver differential data jitter.
mgr871
T
PERIOD
t
JR
differential
data lines
+
3.3 V
0 V
t
JR1
t
JR2
consecutive
transitions
N
×
T
PERIOD
+
t
JR1
paired
transitions
N
×
T
PERIOD
+
t
JR2
Fig 17. Receiver SE0 width tolerance.
mgr872
differential
data lines
+
3.3 V
0 V
t
FST
V
IH(min)
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PDF描述
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