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參數(shù)資料
| 型號： | IDT82V3202NLG |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 56/117頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC PLL WAN EBU SGL 68-VFQFPN |
| 標(biāo)準(zhǔn)包裝： | 21 |
| 類型： | 時(shí)鐘/頻率發(fā)生器，多路復(fù)用器 |
| PLL： | 是 |
| 主要目的： | 以太網(wǎng)，SONET/SDH，Stratum |
| 輸入： | CMOS |
| 輸出： | CMOS，LVDS，PECL |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 2:2 |
| 差分 - 輸入:輸出： | 無/是 |
| 頻率 - 最大： | 622.08MHz |
| 電源電壓： | 3 V ~ 3.6 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 68-VFQFN 裸露焊盤 |
| 供應(yīng)商設(shè)備封裝： | 68-VFQFPN（10x10） |
| 包裝： | 托盤 |
| 其它名稱： | 82V3202NLG |
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IDT82V3202
EBU WAN PLL
I2C Programming Interface
43
September 11, 2009
4.1.1
DATA TRANSFER FORMAT
Two kinds of data transfer formats are supported by the
IDT82V3202:
Slave-receiver mode (Write);
Slave-transmitter mode (Read);
4.1.1.1
Slave-receiver Mode (Write)
The Slave-receiver mode is as shown in Figure 14.
The Master device asserts the slave address followed by the Write
bit. The Slave device acknowledges and the Master device delivers the
address byte. The Slave device again acknowledges before the Master
device sends the data byte. The Slave device acknowledges each byte,
and the entire transaction is finished with a STOP condition.
Figure 14. Slave-receiver Mode
4.1.1.2
Slave-transmitter Mode (Read)
The Slave-transmitter mode is as shown in Figure 15.
First the Master device must write an address byte to the slave
device. Then it must follow that address byte with a repeated START
condition to denote a read from that device’s address. The Slave device
then returns one byte data corresponding the address. Note that there is
no STOP condition before the repeated STRAT condition, and that a no-
acknowledge (NACK) signifies the end of the read transfer.
Figure 15. Slave-transmitter Mode
A
S
17
1
8
1
81
1
Slave Address
Wr
Address Byte
Data Byte
P
S
Start Condition
Wr
Write (bit value of 0)
Master-to-Slave
Slave-to-Master
Acknowledge (this bit position may be ‘0’ for an ACK or ‘1’ for a NACK)
A
Stop Condition
P
S
Slave Address
Wr
Address Byte
A
S
Slave Address
Rd
A
Data Byte
A
P
11
8
1
7
1
8
1
7
1
S
Start Condition
Rd
Read (bit value of 1)
Wr
Write (bit value of 0)
Stop Condition
Master-to-Slave
Slave-to-Master
P
Acknowledge (this bit position may be ‘0’ for an ACK or ‘1’ for a NACK)
A
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