參數(shù)資料
型號(hào)： HM5212805F
廠商： Hitachi,Ltd.
英文描述： 128M LVTTL interface SDRAM(128M LVTTL 接口同步DRAM)
中文描述： 128M的LVTTL接口的SDRAM（128M的LVTTL接口同步的DRAM）
文件頁(yè)數(shù)： 55/63頁(yè)
文件大?。?/td> 858K
代理商： HM5212805F
HM5212165F/HM5212805F-75/A60/B60
55
Read/Single Write Cycle
+
4
5
=
*
+
3
+
3
4
=
+
3
4
5
=
>
#
,
4
5
>
#
+
,
4
#
+
,
4
5
"
#
+
A
DQ (input)
DQ (output)
H
I
7
H
I
0
1
2
3
5
6
7
8
N
9
10
11
12
13
14
15
16
17
18
19
20
H
O
R:a
C:a
R:b
C:a'
H
I
H
I
E
N
O
R:a
C:a
C:a
N
O
a
a
a
a
7
H
A
I
J
A
I
J
8
A
B
J
8
A
J
/
8
A
/
7
8
.
7
8
Bank 0
Active
Bank 0
Read
Bank 3
Active
Bank 0
Write
Bank 0
Precharge
Bank 3
Precharge
Bank 0
Active
Bank 0
Read
Bank 0
Write
Bank 0
Precharge
N
"
#
+
R:b
Bank 3
Active
$
#
#
#
#
1
2
9
:
C
(
1
9
:
(
0
1
9
'
(
0
1
9
I
H
I
&
'
.
/
8
&
'
/
0
8
'
(
/
0
8
'
(
0
1
8
9
(
0
1
8
9
B
C:a
Bank 0
Read
a
a+1 a+2 a+3
@
A
I
'
(
/
0
8
9
A
9
B
C
K
9
A
B
K
0
8
9
A
B
0
8
9
A
J
A
J
A
I
J
@
A
I
J
Bank 0
Write
Bank 0
Write
CKE
E
RAS
CS
CAS
WE
Address
DQM,
DQMU/DQML
DQ (input)
DQ (output)
CLK
BS
CKE
RAS
CS
CAS
WE
BS
Address
DQM,
DQMU/DQML
E
M
N
)
C:b
b
c
a+1
a+3
a+1 a+2 a+3
C:c
G
O
P
F
M
N
F
N
O
$
,
5
>
4L
V
IH
V
IH
Read/Single write
RAS
-
CAS
delay = 3
CAS
latency = 3
Burst length = 4
= V or V
IH
IL
相關(guān)PDF資料
PDF描述
HM5212165F 128M LVTTL interface SDRAM(128M LVTTL 接口同步DRAM)
HM5225165BTT-75 256M LVTTL interface SDRAM 133 MHz/100 MHz 4-Mword 】 16-bit 】 4-bank/8-Mword 】 8-bit 】 4-bank /16-Mword 】 4-bit 】 4-bank PC/133, PC/100 SDRAM
HM5225805BLTT-A6 256M LVTTL interface SDRAM 133 MHz/100 MHz 4-Mword 】 16-bit 】 4-bank/8-Mword 】 8-bit 】 4-bank /16-Mword 】 4-bit 】 4-bank PC/133, PC/100 SDRAM
HM5225405B-B6 256M LVTTL interface SDRAM 133 MHz/100 MHz 4-Mword 】 16-bit 】 4-bank/8-Mword 】 8-bit 】 4-bank /16-Mword 】 4-bit 】 4-bank PC/133, PC/100 SDRAM
HM5225405BLTT-75 POT 20K OHM 9MM HORZ NO BUSHING
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參數(shù)描述
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