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參數(shù)資料
| 型號： | AT85C51SND3B1-RTTUL |
| 廠商： | Atmel |
| 文件頁數(shù)： | 85/119頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC DECODER/ENCODER DGTL 100-LQFP |
| 標(biāo)準(zhǔn)包裝： | 90 |
| 類型： | 音頻編碼器/解碼器 |
| 應(yīng)用： | 移動電話，手機，視頻顯示器 |
| 電壓 - 電源，數(shù)字： | 1.65 V ~ 3.6 V |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 100-LQFP |
| 供應(yīng)商設(shè)備封裝： | 100-LQFP（14x14） |
| 包裝： | 托盤 |
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AT85C51SND3B
7632D–MP3–01/07
Figure 36. Timer/Counter x (x = 0 or 1) in Mode 2
Figure 37. Mode 2 Auto-reload Period Formula
Mode 3 (2 x 8-bit Timers)
Mode 3 configures Timer 0 such that registers TL0 and TH0 operate as separate 8-bit
Timers (see Figure 38). This mode is provided for applications requiring an additional 8-
bit Timer or Counter. TL0 uses the Timer 0 control bits C/T0# and GATE0 in TMOD reg-
ister, and TR0 and TF0 in TCON register in the normal manner. TH0 is locked into a
Timer function (counting FTF1/6) and takes over use of the Timer 1 interrupt (TF1) and
run control (TR1) bits. Thus, operation of Timer 1 is restricted when Timer 0 is in mode
3. Figure 39 gives the auto-reload period calculation formulas for both TF0 and TF1
flags.
Figure 38. Timer/Counter 0 in Mode 3: 2 8-bit Counters
Figure 39. Mode 3 Overflow Period Formula
TFx
TCON reg
Overflow
Timer x
Interrupt
Request
TLx
(8 bits)
THx
(8 bits)
0
1
GATEx
TMOD Reg
C/Tx#
TMOD Reg
INTx
Tx
TIMx
CLOCK
÷
6
TRx
TCON Reg
TFx
PER=
FTIMx
6
(256 – THx)
TF1
TCON.7
TF0
TCON.5
0
1
GATE0
TMOD.3
Overflow
Timer 0
Interrupt
Request
C/T0#
TMOD.2
INTx
Tx
TIM0
CLOCK
÷
6
TR0
TCON.4
TL0
(8 bits)
Overflow
Timer 1
Interrupt
Request
TH0
(8 bits)
TIM0
CLOCK
÷
6
TR1
TCON.6
TF0
PER
=
FTIM0
6
(256 – TL0)
TF1PER =
F
TIM0
6
(256 – TH0)
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