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參數(shù)資料
| 型號(hào)： | AT85C51SND3B1-RTTUL |
| 廠商： | Atmel |
| 文件頁數(shù)： | 116/119頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC DECODER/ENCODER DGTL 100-LQFP |
| 標(biāo)準(zhǔn)包裝： | 90 |
| 類型： | 音頻編碼器/解碼器 |
| 應(yīng)用： | 移動(dòng)電話，手機(jī)，視頻顯示器 |
| 電壓 - 電源，數(shù)字： | 1.65 V ~ 3.6 V |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 100-LQFP |
| 供應(yīng)商設(shè)備封裝： | 100-LQFP（14x14） |
| 包裝： | 托盤 |
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96
AT85C51SND3B
7632D–MP3–01/07
Reset Value = 0000 0000b
Table 105. UDPADDH Register
UDPADDH (1.E4h) – USB Dual Port Ram Direct Access High Register
7
6
5
4
3
2
1
0
DPACC
-
DPADD10:8
Bit
Number
Bit
Mnemonic Description
7
DPACC
DPRAM Direct Access Bit
Set this bit to directly read the content the Dual-Port RAM (DPR) data through
the UEDATX or UPDATX registers. See Section “Memory Access Capability” for
more details.
Clear this bit for normal operation and access the DPR through the endpoint
FIFO.
6-3
-
Reserved
The value read from these bits is always 0. Do not set these bits.
2-0
DPADD10:8
DPRAM Address High Bit
DPADD10:8 is the most significant part of DPADD. The least significant part is
provided by the UDPADDL register.
Table 106. UDPADDL Register
UDPADDL (1.E5h) – USB Dual Port Ram Direct Access High Register
7
6
5
4
3
2
1
0
DPADD7:0
Bit
Number
Bit
Mnemonic Description
7-0
DPADD7:0
DPRAM Address Low Bit
DAPDD7:0 is the least significant part of DPADD. The most significant part is
provided by the UDPADDH register.
Table 107. OTGCON Register
OTGCON (1.E6h) – USB OTG Control Register
7
6
5
4
3
2
1
0
0
-
HNPREQ
SRPREQ
SRPSEL
VBUSHWC
VBUSREQ
VBUSRQC
Bit
Number
Bit
Mnemonic Description
7
0
OTGCON pagination
This bit must be cleared to access the OTGCON register.
6
-
Reserved
The value read from these bits is always 0. Do not set these bits.
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