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參數(shù)資料
| 型號： | AT85C51SND3B1-RTTUL |
| 廠商： | Atmel |
| 文件頁數(shù)： | 68/119頁 |
| 文件大小： | 0K |
| 描述： | IC DECODER/ENCODER DGTL 100-LQFP |
| 標(biāo)準(zhǔn)包裝： | 90 |
| 類型： | 音頻編碼器/解碼器 |
| 應(yīng)用： | 移動(dòng)電話，手機(jī)，視頻顯示器 |
| 電壓 - 電源，數(shù)字： | 1.65 V ~ 3.6 V |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 100-LQFP |
| 供應(yīng)商設(shè)備封裝： | 100-LQFP（14x14） |
| 包裝： | 托盤 |
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52
AT85C51SND3B
7632D–MP3–01/07
The Figure 27 shows the memory segments configuration after bootstrap execution
along with an example of user memory segments configuration done during firmware
start-up. In this figure italicized address are the logical address within segments.
Figure 27. Memory Segment Configuration
Registers
Reset Value = 0000 0000b
0000h
FFFFh
FF00h
FEFFh
F000h
EFFFh
00h
FFh
256-byte DATA
000h
EFFh
3840-byte XDATA
60-Kbyte CODE
EFFFh
0000h
FFFFh
FF00h
FEFFh
E000h
DFFFh
00h
FFh
256-byte DATA
000h
1EFFh
7936-byte XDATA
56-Kbyte CODE
DFFFh
0000h
Default Configuration
User Configuration Example
MEMCBAX = 00h
MEMXBAX = 78h
MEMDBAX = 7Fh
MEMCSX = EFh
MEMXSX = 0Eh
MEMCBAX = 00h
MEMXBAX = 70h
MEMDBAX = 7Fh
MEMCSX = DFh
MEMXSX = 1Eh
Table 64. PSW Register
PSW (S:8Eh) – Program Status Word Register
7
6
5
4
3
2
1
0
CY
AC
F0
RS1
RS0
OV
F1
P
Bit
Number
Bit
Mnemonic Description
7
CY
Carry Flag
Carry out from bit 1 of ALU operands.
6
AC
Auxiliary Carry Flag
Carry out from bit 1 of addition operands.
5
F0
User Definable Flag 0
4-3
RS1:0
Register Bank Select Bits
Refer to Table 63 for bits description.
2
OV
Overflow Flag
Overflow set by arithmetic operations.
1
F1
User Definable Flag 1
0
P
Parity Bit
Set when ACC contains an odd number of 1’s.
Cleared when ACC contains an even number of 1’s.
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PDF描述 |
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參數(shù)描述 |
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