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參數(shù)資料
| 型號： | 9S12KT256DGV1 |
| 英文描述： | MC9S12KT256 Device User Guide |
| 中文描述： | MC9S12KT256設(shè)備用戶指南 |
| 文件頁數(shù)： | 109/126頁 |
| 文件大?。?/td> | 7307K |
| 代理商： | 9S12KT256DGV1 |
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Device User Guide — 9S12KT256DGV1/D V01.09
109
Freescale Semiconductor
Figure A-4 Jitter Definitions
The relative deviation of t
nom
is at its maximum for one clock period, and decreases towards zero for larger
number of clock periods (N).
Defining the jitter as:
NOTE:
From the evaluation data a formula for t
max
= f(N), resp. t
min
= f(N) should be
derived.
Assuming no long term drift of the reference clock, the following will hold
This is very important to notice with respect to timers, serial modules where a pre-scaler will eliminate the
effect of the jitter to a large extent.
2
3
N-1
N
1
0
t
nom
t
max1
t
min1
t
maxN
t
minN
J N
max 1
t
max
N
N t
nom
( )
---------------------
–
1
t
min
N
N t
nom
( )
--------------------
–
,
=
J N
∞
N
→
lim
0
=
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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